1/*	$NetBSD: qcom,gcc-sdm845.h,v 1.1.1.3 2019/05/25 11:29:13 jmcneill Exp $	*/
2
3/* SPDX-License-Identifier: GPL-2.0 */
4/*
5 * Copyright (c) 2018, The Linux Foundation. All rights reserved.
6 */
7
8#ifndef _DT_BINDINGS_CLK_SDM_GCC_SDM845_H
9#define _DT_BINDINGS_CLK_SDM_GCC_SDM845_H
10
11/* GCC clock registers */
12#define GCC_AGGRE_NOC_PCIE_TBU_CLK				0
13#define GCC_AGGRE_UFS_CARD_AXI_CLK				1
14#define GCC_AGGRE_UFS_PHY_AXI_CLK				2
15#define GCC_AGGRE_USB3_PRIM_AXI_CLK				3
16#define GCC_AGGRE_USB3_SEC_AXI_CLK				4
17#define GCC_BOOT_ROM_AHB_CLK					5
18#define GCC_CAMERA_AHB_CLK					6
19#define GCC_CAMERA_AXI_CLK					7
20#define GCC_CAMERA_XO_CLK					8
21#define GCC_CE1_AHB_CLK						9
22#define GCC_CE1_AXI_CLK						10
23#define GCC_CE1_CLK						11
24#define GCC_CFG_NOC_USB3_PRIM_AXI_CLK				12
25#define GCC_CFG_NOC_USB3_SEC_AXI_CLK				13
26#define GCC_CPUSS_AHB_CLK					14
27#define GCC_CPUSS_AHB_CLK_SRC					15
28#define GCC_CPUSS_RBCPR_CLK					16
29#define GCC_CPUSS_RBCPR_CLK_SRC					17
30#define GCC_DDRSS_GPU_AXI_CLK					18
31#define GCC_DISP_AHB_CLK					19
32#define GCC_DISP_AXI_CLK					20
33#define GCC_DISP_GPLL0_CLK_SRC					21
34#define GCC_DISP_GPLL0_DIV_CLK_SRC				22
35#define GCC_DISP_XO_CLK						23
36#define GCC_GP1_CLK						24
37#define GCC_GP1_CLK_SRC						25
38#define GCC_GP2_CLK						26
39#define GCC_GP2_CLK_SRC						27
40#define GCC_GP3_CLK						28
41#define GCC_GP3_CLK_SRC						29
42#define GCC_GPU_CFG_AHB_CLK					30
43#define GCC_GPU_GPLL0_CLK_SRC					31
44#define GCC_GPU_GPLL0_DIV_CLK_SRC				32
45#define GCC_GPU_MEMNOC_GFX_CLK					33
46#define GCC_GPU_SNOC_DVM_GFX_CLK				34
47#define GCC_MSS_AXIS2_CLK					35
48#define GCC_MSS_CFG_AHB_CLK					36
49#define GCC_MSS_GPLL0_DIV_CLK_SRC				37
50#define GCC_MSS_MFAB_AXIS_CLK					38
51#define GCC_MSS_Q6_MEMNOC_AXI_CLK				39
52#define GCC_MSS_SNOC_AXI_CLK					40
53#define GCC_PCIE_0_AUX_CLK					41
54#define GCC_PCIE_0_AUX_CLK_SRC					42
55#define GCC_PCIE_0_CFG_AHB_CLK					43
56#define GCC_PCIE_0_CLKREF_CLK					44
57#define GCC_PCIE_0_MSTR_AXI_CLK					45
58#define GCC_PCIE_0_PIPE_CLK					46
59#define GCC_PCIE_0_SLV_AXI_CLK					47
60#define GCC_PCIE_0_SLV_Q2A_AXI_CLK				48
61#define GCC_PCIE_1_AUX_CLK					49
62#define GCC_PCIE_1_AUX_CLK_SRC					50
63#define GCC_PCIE_1_CFG_AHB_CLK					51
64#define GCC_PCIE_1_CLKREF_CLK					52
65#define GCC_PCIE_1_MSTR_AXI_CLK					53
66#define GCC_PCIE_1_PIPE_CLK					54
67#define GCC_PCIE_1_SLV_AXI_CLK					55
68#define GCC_PCIE_1_SLV_Q2A_AXI_CLK				56
69#define GCC_PCIE_PHY_AUX_CLK					57
70#define GCC_PCIE_PHY_REFGEN_CLK					58
71#define GCC_PCIE_PHY_REFGEN_CLK_SRC				59
72#define GCC_PDM2_CLK						60
73#define GCC_PDM2_CLK_SRC					61
74#define GCC_PDM_AHB_CLK						62
75#define GCC_PDM_XO4_CLK						63
76#define GCC_PRNG_AHB_CLK					64
77#define GCC_QMIP_CAMERA_AHB_CLK					65
78#define GCC_QMIP_DISP_AHB_CLK					66
79#define GCC_QMIP_VIDEO_AHB_CLK					67
80#define GCC_QUPV3_WRAP0_S0_CLK					68
81#define GCC_QUPV3_WRAP0_S0_CLK_SRC				69
82#define GCC_QUPV3_WRAP0_S1_CLK					70
83#define GCC_QUPV3_WRAP0_S1_CLK_SRC				71
84#define GCC_QUPV3_WRAP0_S2_CLK					72
85#define GCC_QUPV3_WRAP0_S2_CLK_SRC				73
86#define GCC_QUPV3_WRAP0_S3_CLK					74
87#define GCC_QUPV3_WRAP0_S3_CLK_SRC				75
88#define GCC_QUPV3_WRAP0_S4_CLK					76
89#define GCC_QUPV3_WRAP0_S4_CLK_SRC				77
90#define GCC_QUPV3_WRAP0_S5_CLK					78
91#define GCC_QUPV3_WRAP0_S5_CLK_SRC				79
92#define GCC_QUPV3_WRAP0_S6_CLK					80
93#define GCC_QUPV3_WRAP0_S6_CLK_SRC				81
94#define GCC_QUPV3_WRAP0_S7_CLK					82
95#define GCC_QUPV3_WRAP0_S7_CLK_SRC				83
96#define GCC_QUPV3_WRAP1_S0_CLK					84
97#define GCC_QUPV3_WRAP1_S0_CLK_SRC				85
98#define GCC_QUPV3_WRAP1_S1_CLK					86
99#define GCC_QUPV3_WRAP1_S1_CLK_SRC				87
100#define GCC_QUPV3_WRAP1_S2_CLK					88
101#define GCC_QUPV3_WRAP1_S2_CLK_SRC				89
102#define GCC_QUPV3_WRAP1_S3_CLK					90
103#define GCC_QUPV3_WRAP1_S3_CLK_SRC				91
104#define GCC_QUPV3_WRAP1_S4_CLK					92
105#define GCC_QUPV3_WRAP1_S4_CLK_SRC				93
106#define GCC_QUPV3_WRAP1_S5_CLK					94
107#define GCC_QUPV3_WRAP1_S5_CLK_SRC				95
108#define GCC_QUPV3_WRAP1_S6_CLK					96
109#define GCC_QUPV3_WRAP1_S6_CLK_SRC				97
110#define GCC_QUPV3_WRAP1_S7_CLK					98
111#define GCC_QUPV3_WRAP1_S7_CLK_SRC				99
112#define GCC_QUPV3_WRAP_0_M_AHB_CLK				100
113#define GCC_QUPV3_WRAP_0_S_AHB_CLK				101
114#define GCC_QUPV3_WRAP_1_M_AHB_CLK				102
115#define GCC_QUPV3_WRAP_1_S_AHB_CLK				103
116#define GCC_SDCC2_AHB_CLK					104
117#define GCC_SDCC2_APPS_CLK					105
118#define GCC_SDCC2_APPS_CLK_SRC					106
119#define GCC_SDCC4_AHB_CLK					107
120#define GCC_SDCC4_APPS_CLK					108
121#define GCC_SDCC4_APPS_CLK_SRC					109
122#define GCC_SYS_NOC_CPUSS_AHB_CLK				110
123#define GCC_TSIF_AHB_CLK					111
124#define GCC_TSIF_INACTIVITY_TIMERS_CLK				112
125#define GCC_TSIF_REF_CLK					113
126#define GCC_TSIF_REF_CLK_SRC					114
127#define GCC_UFS_CARD_AHB_CLK					115
128#define GCC_UFS_CARD_AXI_CLK					116
129#define GCC_UFS_CARD_AXI_CLK_SRC				117
130#define GCC_UFS_CARD_CLKREF_CLK					118
131#define GCC_UFS_CARD_ICE_CORE_CLK				119
132#define GCC_UFS_CARD_ICE_CORE_CLK_SRC				120
133#define GCC_UFS_CARD_PHY_AUX_CLK				121
134#define GCC_UFS_CARD_PHY_AUX_CLK_SRC				122
135#define GCC_UFS_CARD_RX_SYMBOL_0_CLK				123
136#define GCC_UFS_CARD_RX_SYMBOL_1_CLK				124
137#define GCC_UFS_CARD_TX_SYMBOL_0_CLK				125
138#define GCC_UFS_CARD_UNIPRO_CORE_CLK				126
139#define GCC_UFS_CARD_UNIPRO_CORE_CLK_SRC			127
140#define GCC_UFS_MEM_CLKREF_CLK					128
141#define GCC_UFS_PHY_AHB_CLK					129
142#define GCC_UFS_PHY_AXI_CLK					130
143#define GCC_UFS_PHY_AXI_CLK_SRC					131
144#define GCC_UFS_PHY_ICE_CORE_CLK				132
145#define GCC_UFS_PHY_ICE_CORE_CLK_SRC				133
146#define GCC_UFS_PHY_PHY_AUX_CLK					134
147#define GCC_UFS_PHY_PHY_AUX_CLK_SRC				135
148#define GCC_UFS_PHY_RX_SYMBOL_0_CLK				136
149#define GCC_UFS_PHY_RX_SYMBOL_1_CLK				137
150#define GCC_UFS_PHY_TX_SYMBOL_0_CLK				138
151#define GCC_UFS_PHY_UNIPRO_CORE_CLK				139
152#define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC				140
153#define GCC_USB30_PRIM_MASTER_CLK				141
154#define GCC_USB30_PRIM_MASTER_CLK_SRC				142
155#define GCC_USB30_PRIM_MOCK_UTMI_CLK				143
156#define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC			144
157#define GCC_USB30_PRIM_SLEEP_CLK				145
158#define GCC_USB30_SEC_MASTER_CLK				146
159#define GCC_USB30_SEC_MASTER_CLK_SRC				147
160#define GCC_USB30_SEC_MOCK_UTMI_CLK				148
161#define GCC_USB30_SEC_MOCK_UTMI_CLK_SRC				149
162#define GCC_USB30_SEC_SLEEP_CLK					150
163#define GCC_USB3_PRIM_CLKREF_CLK				151
164#define GCC_USB3_PRIM_PHY_AUX_CLK				152
165#define GCC_USB3_PRIM_PHY_AUX_CLK_SRC				153
166#define GCC_USB3_PRIM_PHY_COM_AUX_CLK				154
167#define GCC_USB3_PRIM_PHY_PIPE_CLK				155
168#define GCC_USB3_SEC_CLKREF_CLK					156
169#define GCC_USB3_SEC_PHY_AUX_CLK				157
170#define GCC_USB3_SEC_PHY_AUX_CLK_SRC				158
171#define GCC_USB3_SEC_PHY_PIPE_CLK				159
172#define GCC_USB3_SEC_PHY_COM_AUX_CLK				160
173#define GCC_USB_PHY_CFG_AHB2PHY_CLK				161
174#define GCC_VIDEO_AHB_CLK					162
175#define GCC_VIDEO_AXI_CLK					163
176#define GCC_VIDEO_XO_CLK					164
177#define GPLL0							165
178#define GPLL0_OUT_EVEN						166
179#define GPLL0_OUT_MAIN						167
180#define GCC_GPU_IREF_CLK					168
181#define GCC_SDCC1_AHB_CLK					169
182#define GCC_SDCC1_APPS_CLK					170
183#define GCC_SDCC1_ICE_CORE_CLK					171
184#define GCC_SDCC1_APPS_CLK_SRC					172
185#define GCC_SDCC1_ICE_CORE_CLK_SRC				173
186#define GCC_APC_VS_CLK						174
187#define GCC_GPU_VS_CLK						175
188#define GCC_MSS_VS_CLK						176
189#define GCC_VDDA_VS_CLK						177
190#define GCC_VDDCX_VS_CLK					178
191#define GCC_VDDMX_VS_CLK					179
192#define GCC_VS_CTRL_AHB_CLK					180
193#define GCC_VS_CTRL_CLK						181
194#define GCC_VS_CTRL_CLK_SRC					182
195#define GCC_VSENSOR_CLK_SRC					183
196#define GPLL4							184
197#define GCC_CPUSS_DVM_BUS_CLK					185
198#define GCC_CPUSS_GNOC_CLK					186
199#define GCC_QSPI_CORE_CLK_SRC					187
200#define GCC_QSPI_CORE_CLK					188
201#define GCC_QSPI_CNOC_PERIPH_AHB_CLK				189
202#define GCC_LPASS_Q6_AXI_CLK					190
203#define GCC_LPASS_SWAY_CLK					191
204
205/* GCC Resets */
206#define GCC_MMSS_BCR						0
207#define GCC_PCIE_0_BCR						1
208#define GCC_PCIE_1_BCR						2
209#define GCC_PCIE_PHY_BCR					3
210#define GCC_PDM_BCR						4
211#define GCC_PRNG_BCR						5
212#define GCC_QUPV3_WRAPPER_0_BCR					6
213#define GCC_QUPV3_WRAPPER_1_BCR					7
214#define GCC_QUSB2PHY_PRIM_BCR					8
215#define GCC_QUSB2PHY_SEC_BCR					9
216#define GCC_SDCC2_BCR						10
217#define GCC_SDCC4_BCR						11
218#define GCC_TSIF_BCR						12
219#define GCC_UFS_CARD_BCR					13
220#define GCC_UFS_PHY_BCR						14
221#define GCC_USB30_PRIM_BCR					15
222#define GCC_USB30_SEC_BCR					16
223#define GCC_USB3_PHY_PRIM_BCR					17
224#define GCC_USB3PHY_PHY_PRIM_BCR				18
225#define GCC_USB3_DP_PHY_PRIM_BCR				19
226#define GCC_USB3_PHY_SEC_BCR					20
227#define GCC_USB3PHY_PHY_SEC_BCR					21
228#define GCC_USB3_DP_PHY_SEC_BCR					22
229#define GCC_USB_PHY_CFG_AHB2PHY_BCR				23
230#define GCC_PCIE_0_PHY_BCR					24
231#define GCC_PCIE_1_PHY_BCR					25
232
233/* GCC GDSCRs */
234#define PCIE_0_GDSC						0
235#define PCIE_1_GDSC						1
236#define UFS_CARD_GDSC						2
237#define UFS_PHY_GDSC						3
238#define USB30_PRIM_GDSC						4
239#define USB30_SEC_GDSC						5
240#define HLOS1_VOTE_AGGRE_NOC_MMU_AUDIO_TBU_GDSC			6
241#define HLOS1_VOTE_AGGRE_NOC_MMU_PCIE_TBU_GDSC			7
242#define HLOS1_VOTE_AGGRE_NOC_MMU_TBU1_GDSC			8
243#define HLOS1_VOTE_AGGRE_NOC_MMU_TBU2_GDSC			9
244#define HLOS1_VOTE_MMNOC_MMU_TBU_HF0_GDSC			10
245#define HLOS1_VOTE_MMNOC_MMU_TBU_HF1_GDSC			11
246#define HLOS1_VOTE_MMNOC_MMU_TBU_SF_GDSC			12
247
248#endif
249