1/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
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3 * Copyright (c) 2023, Qualcomm Innovation Center, Inc. All rights reserved.
4 */
5
6#ifndef _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H
7#define _DT_BINDINGS_CLK_QCOM_GCC_X1E80100_H
8
9/* GCC clocks */
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314#define GCC_USB4_0_PHY_RX0_CLK					304
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324#define GCC_USB4_1_DP1_CLK					314
325#define GCC_USB4_1_MASTER_CLK					315
326#define GCC_USB4_1_MASTER_CLK_SRC				316
327#define GCC_USB4_1_PHY_P2RR2P_PIPE_CLK				317
328#define GCC_USB4_1_PHY_PCIE_PIPE_CLK				318
329#define GCC_USB4_1_PHY_PCIE_PIPE_CLK_SRC			319
330#define GCC_USB4_1_PHY_RX0_CLK					320
331#define GCC_USB4_1_PHY_RX1_CLK					321
332#define GCC_USB4_1_PHY_USB_PIPE_CLK				322
333#define GCC_USB4_1_SB_IF_CLK					323
334#define GCC_USB4_1_SB_IF_CLK_SRC				324
335#define GCC_USB4_1_SYS_CLK					325
336#define GCC_USB4_1_TMU_CLK					326
337#define GCC_USB4_1_TMU_CLK_SRC					327
338#define GCC_USB4_2_CFG_AHB_CLK					328
339#define GCC_USB4_2_DP0_CLK					329
340#define GCC_USB4_2_DP1_CLK					330
341#define GCC_USB4_2_MASTER_CLK					331
342#define GCC_USB4_2_MASTER_CLK_SRC				332
343#define GCC_USB4_2_PHY_P2RR2P_PIPE_CLK				333
344#define GCC_USB4_2_PHY_PCIE_PIPE_CLK				334
345#define GCC_USB4_2_PHY_PCIE_PIPE_CLK_SRC			335
346#define GCC_USB4_2_PHY_RX0_CLK					336
347#define GCC_USB4_2_PHY_RX1_CLK					337
348#define GCC_USB4_2_PHY_USB_PIPE_CLK				338
349#define GCC_USB4_2_SB_IF_CLK					339
350#define GCC_USB4_2_SB_IF_CLK_SRC				340
351#define GCC_USB4_2_SYS_CLK					341
352#define GCC_USB4_2_TMU_CLK					342
353#define GCC_USB4_2_TMU_CLK_SRC					343
354#define GCC_VIDEO_AHB_CLK					344
355#define GCC_VIDEO_AXI0_CLK					345
356#define GCC_VIDEO_AXI1_CLK					346
357#define GCC_VIDEO_XO_CLK					347
358#define GCC_PCIE_3_PIPE_CLK_SRC					348
359#define GCC_PCIE_4_PIPE_CLK_SRC					349
360#define GCC_PCIE_5_PIPE_CLK_SRC					350
361#define GCC_PCIE_6A_PIPE_CLK_SRC				351
362#define GCC_PCIE_6B_PIPE_CLK_SRC				352
363#define GCC_USB3_PRIM_PHY_PIPE_CLK_SRC				353
364#define GCC_USB3_SEC_PHY_PIPE_CLK_SRC				354
365#define GCC_USB3_TERT_PHY_PIPE_CLK_SRC				355
366
367/* GCC power domains */
368#define GCC_PCIE_0_TUNNEL_GDSC					0
369#define GCC_PCIE_1_TUNNEL_GDSC					1
370#define GCC_PCIE_2_TUNNEL_GDSC					2
371#define GCC_PCIE_3_GDSC						3
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373#define GCC_PCIE_4_GDSC						5
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375#define GCC_PCIE_5_GDSC						7
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379#define GCC_PCIE_6B_GDSC					11
380#define GCC_UFS_MEM_PHY_GDSC					12
381#define GCC_UFS_PHY_GDSC					13
382#define GCC_USB20_PRIM_GDSC					14
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384#define GCC_USB30_PRIM_GDSC					16
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387#define GCC_USB3_MP_SS0_PHY_GDSC				19
388#define GCC_USB3_MP_SS1_PHY_GDSC				20
389#define GCC_USB4_0_GDSC						21
390#define GCC_USB4_1_GDSC						22
391#define GCC_USB4_2_GDSC						23
392#define GCC_USB_0_PHY_GDSC					24
393#define GCC_USB_1_PHY_GDSC					25
394#define GCC_USB_2_PHY_GDSC					26
395
396/* GCC resets */
397#define GCC_AV1E_BCR						0
398#define GCC_CAMERA_BCR						1
399#define GCC_DISPLAY_BCR						2
400#define GCC_GPU_BCR						3
401#define GCC_PCIE_0_LINK_DOWN_BCR				4
402#define GCC_PCIE_0_NOCSR_COM_PHY_BCR				5
403#define GCC_PCIE_0_PHY_BCR					6
404#define GCC_PCIE_0_PHY_NOCSR_COM_PHY_BCR			7
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406#define GCC_PCIE_1_LINK_DOWN_BCR				9
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409#define GCC_PCIE_1_PHY_NOCSR_COM_PHY_BCR			12
410#define GCC_PCIE_1_TUNNEL_BCR					13
411#define GCC_PCIE_2_LINK_DOWN_BCR				14
412#define GCC_PCIE_2_NOCSR_COM_PHY_BCR				15
413#define GCC_PCIE_2_PHY_BCR					16
414#define GCC_PCIE_2_PHY_NOCSR_COM_PHY_BCR			17
415#define GCC_PCIE_2_TUNNEL_BCR					18
416#define GCC_PCIE_3_BCR						19
417#define GCC_PCIE_3_LINK_DOWN_BCR				20
418#define GCC_PCIE_3_NOCSR_COM_PHY_BCR				21
419#define GCC_PCIE_3_PHY_BCR					22
420#define GCC_PCIE_3_PHY_NOCSR_COM_PHY_BCR			23
421#define GCC_PCIE_4_BCR						24
422#define GCC_PCIE_4_LINK_DOWN_BCR				25
423#define GCC_PCIE_4_NOCSR_COM_PHY_BCR				26
424#define GCC_PCIE_4_PHY_BCR					27
425#define GCC_PCIE_4_PHY_NOCSR_COM_PHY_BCR			28
426#define GCC_PCIE_5_BCR						29
427#define GCC_PCIE_5_LINK_DOWN_BCR				30
428#define GCC_PCIE_5_NOCSR_COM_PHY_BCR				31
429#define GCC_PCIE_5_PHY_BCR					32
430#define GCC_PCIE_5_PHY_NOCSR_COM_PHY_BCR			33
431#define GCC_PCIE_6A_BCR						34
432#define GCC_PCIE_6A_LINK_DOWN_BCR				35
433#define GCC_PCIE_6A_NOCSR_COM_PHY_BCR				36
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435#define GCC_PCIE_6A_PHY_NOCSR_COM_PHY_BCR			38
436#define GCC_PCIE_6B_BCR						39
437#define GCC_PCIE_6B_LINK_DOWN_BCR				40
438#define GCC_PCIE_6B_NOCSR_COM_PHY_BCR				41
439#define GCC_PCIE_6B_PHY_BCR					42
440#define GCC_PCIE_6B_PHY_NOCSR_COM_PHY_BCR			43
441#define GCC_PCIE_PHY_BCR					44
442#define GCC_PCIE_PHY_CFG_AHB_BCR				45
443#define GCC_PCIE_PHY_COM_BCR					46
444#define GCC_PCIE_RSCC_BCR					47
445#define GCC_PDM_BCR						48
446#define GCC_QUPV3_WRAPPER_0_BCR					49
447#define GCC_QUPV3_WRAPPER_1_BCR					50
448#define GCC_QUPV3_WRAPPER_2_BCR					51
449#define GCC_QUSB2PHY_HS0_MP_BCR					52
450#define GCC_QUSB2PHY_HS1_MP_BCR					53
451#define GCC_QUSB2PHY_PRIM_BCR					54
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453#define GCC_QUSB2PHY_TERT_BCR					56
454#define GCC_QUSB2PHY_USB20_HS_BCR				57
455#define GCC_SDCC2_BCR						58
456#define GCC_SDCC4_BCR						59
457#define GCC_UFS_PHY_BCR						60
458#define GCC_USB20_PRIM_BCR					61
459#define GCC_USB30_MP_BCR					62
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485#endif
486