1/* SPDX-License-Identifier: GPL-2.0 */
2/*
3 * Copyright (c) 2019, The Linux Foundation. All rights reserved.
4 */
5
6#ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H
7#define _DT_BINDINGS_CLK_QCOM_GCC_SM8150_H
8
9/* GCC clocks */
10#define GCC_AGGRE_NOC_PCIE_TBU_CLK				0
11#define GCC_AGGRE_UFS_CARD_AXI_CLK				1
12#define GCC_AGGRE_UFS_CARD_AXI_HW_CTL_CLK			2
13#define GCC_AGGRE_UFS_PHY_AXI_CLK				3
14#define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK			4
15#define GCC_AGGRE_USB3_PRIM_AXI_CLK				5
16#define GCC_AGGRE_USB3_SEC_AXI_CLK				6
17#define GCC_BOOT_ROM_AHB_CLK					7
18#define GCC_CAMERA_AHB_CLK					8
19#define GCC_CAMERA_HF_AXI_CLK					9
20#define GCC_CAMERA_SF_AXI_CLK					10
21#define GCC_CAMERA_XO_CLK					11
22#define GCC_CFG_NOC_USB3_PRIM_AXI_CLK				12
23#define GCC_CFG_NOC_USB3_SEC_AXI_CLK				13
24#define GCC_CPUSS_AHB_CLK					14
25#define GCC_CPUSS_AHB_CLK_SRC					15
26#define GCC_CPUSS_DVM_BUS_CLK					16
27#define GCC_CPUSS_GNOC_CLK					17
28#define GCC_CPUSS_RBCPR_CLK					18
29#define GCC_DDRSS_GPU_AXI_CLK					19
30#define GCC_DISP_AHB_CLK					20
31#define GCC_DISP_HF_AXI_CLK					21
32#define GCC_DISP_SF_AXI_CLK					22
33#define GCC_DISP_XO_CLK						23
34#define GCC_EMAC_AXI_CLK					24
35#define GCC_EMAC_PTP_CLK					25
36#define GCC_EMAC_PTP_CLK_SRC					26
37#define GCC_EMAC_RGMII_CLK					27
38#define GCC_EMAC_RGMII_CLK_SRC					28
39#define GCC_EMAC_SLV_AHB_CLK					29
40#define GCC_GP1_CLK						30
41#define GCC_GP1_CLK_SRC						31
42#define GCC_GP2_CLK						32
43#define GCC_GP2_CLK_SRC						33
44#define GCC_GP3_CLK						34
45#define GCC_GP3_CLK_SRC						35
46#define GCC_GPU_CFG_AHB_CLK					36
47#define GCC_GPU_GPLL0_CLK_SRC					37
48#define GCC_GPU_GPLL0_DIV_CLK_SRC				38
49#define GCC_GPU_IREF_CLK					39
50#define GCC_GPU_MEMNOC_GFX_CLK					40
51#define GCC_GPU_SNOC_DVM_GFX_CLK				41
52#define GCC_NPU_AT_CLK						42
53#define GCC_NPU_AXI_CLK						43
54#define GCC_NPU_CFG_AHB_CLK					44
55#define GCC_NPU_GPLL0_CLK_SRC					45
56#define GCC_NPU_GPLL0_DIV_CLK_SRC				46
57#define GCC_NPU_TRIG_CLK					47
58#define GCC_PCIE0_PHY_REFGEN_CLK				48
59#define GCC_PCIE1_PHY_REFGEN_CLK				49
60#define GCC_PCIE_0_AUX_CLK					50
61#define GCC_PCIE_0_AUX_CLK_SRC					51
62#define GCC_PCIE_0_CFG_AHB_CLK					52
63#define GCC_PCIE_0_CLKREF_CLK					53
64#define GCC_PCIE_0_MSTR_AXI_CLK					54
65#define GCC_PCIE_0_PIPE_CLK					55
66#define GCC_PCIE_0_SLV_AXI_CLK					56
67#define GCC_PCIE_0_SLV_Q2A_AXI_CLK				57
68#define GCC_PCIE_1_AUX_CLK					58
69#define GCC_PCIE_1_AUX_CLK_SRC					59
70#define GCC_PCIE_1_CFG_AHB_CLK					60
71#define GCC_PCIE_1_CLKREF_CLK					61
72#define GCC_PCIE_1_MSTR_AXI_CLK					62
73#define GCC_PCIE_1_PIPE_CLK					63
74#define GCC_PCIE_1_SLV_AXI_CLK					64
75#define GCC_PCIE_1_SLV_Q2A_AXI_CLK				65
76#define GCC_PCIE_PHY_AUX_CLK					66
77#define GCC_PCIE_PHY_REFGEN_CLK_SRC				67
78#define GCC_PDM2_CLK						68
79#define GCC_PDM2_CLK_SRC					69
80#define GCC_PDM_AHB_CLK						70
81#define GCC_PDM_XO4_CLK						71
82#define GCC_PRNG_AHB_CLK					72
83#define GCC_QMIP_CAMERA_NRT_AHB_CLK				73
84#define GCC_QMIP_CAMERA_RT_AHB_CLK				74
85#define GCC_QMIP_DISP_AHB_CLK					75
86#define GCC_QMIP_VIDEO_CVP_AHB_CLK				76
87#define GCC_QMIP_VIDEO_VCODEC_AHB_CLK				77
88#define GCC_QSPI_CNOC_PERIPH_AHB_CLK				78
89#define GCC_QSPI_CORE_CLK					79
90#define GCC_QSPI_CORE_CLK_SRC					80
91#define GCC_QUPV3_WRAP0_S0_CLK					81
92#define GCC_QUPV3_WRAP0_S0_CLK_SRC				82
93#define GCC_QUPV3_WRAP0_S1_CLK					83
94#define GCC_QUPV3_WRAP0_S1_CLK_SRC				84
95#define GCC_QUPV3_WRAP0_S2_CLK					85
96#define GCC_QUPV3_WRAP0_S2_CLK_SRC				86
97#define GCC_QUPV3_WRAP0_S3_CLK					87
98#define GCC_QUPV3_WRAP0_S3_CLK_SRC				88
99#define GCC_QUPV3_WRAP0_S4_CLK					89
100#define GCC_QUPV3_WRAP0_S4_CLK_SRC				90
101#define GCC_QUPV3_WRAP0_S5_CLK					91
102#define GCC_QUPV3_WRAP0_S5_CLK_SRC				92
103#define GCC_QUPV3_WRAP0_S6_CLK					93
104#define GCC_QUPV3_WRAP0_S6_CLK_SRC				94
105#define GCC_QUPV3_WRAP0_S7_CLK					95
106#define GCC_QUPV3_WRAP0_S7_CLK_SRC				96
107#define GCC_QUPV3_WRAP1_S0_CLK					97
108#define GCC_QUPV3_WRAP1_S0_CLK_SRC				98
109#define GCC_QUPV3_WRAP1_S1_CLK					99
110#define GCC_QUPV3_WRAP1_S1_CLK_SRC				100
111#define GCC_QUPV3_WRAP1_S2_CLK					101
112#define GCC_QUPV3_WRAP1_S2_CLK_SRC				102
113#define GCC_QUPV3_WRAP1_S3_CLK					103
114#define GCC_QUPV3_WRAP1_S3_CLK_SRC				104
115#define GCC_QUPV3_WRAP1_S4_CLK					105
116#define GCC_QUPV3_WRAP1_S4_CLK_SRC				106
117#define GCC_QUPV3_WRAP1_S5_CLK					107
118#define GCC_QUPV3_WRAP1_S5_CLK_SRC				108
119#define GCC_QUPV3_WRAP2_S0_CLK					109
120#define GCC_QUPV3_WRAP2_S0_CLK_SRC				110
121#define GCC_QUPV3_WRAP2_S1_CLK					111
122#define GCC_QUPV3_WRAP2_S1_CLK_SRC				112
123#define GCC_QUPV3_WRAP2_S2_CLK					113
124#define GCC_QUPV3_WRAP2_S2_CLK_SRC				114
125#define GCC_QUPV3_WRAP2_S3_CLK					115
126#define GCC_QUPV3_WRAP2_S3_CLK_SRC				116
127#define GCC_QUPV3_WRAP2_S4_CLK					117
128#define GCC_QUPV3_WRAP2_S4_CLK_SRC				118
129#define GCC_QUPV3_WRAP2_S5_CLK					119
130#define GCC_QUPV3_WRAP2_S5_CLK_SRC				120
131#define GCC_QUPV3_WRAP_0_M_AHB_CLK				121
132#define GCC_QUPV3_WRAP_0_S_AHB_CLK				122
133#define GCC_QUPV3_WRAP_1_M_AHB_CLK				123
134#define GCC_QUPV3_WRAP_1_S_AHB_CLK				124
135#define GCC_QUPV3_WRAP_2_M_AHB_CLK				125
136#define GCC_QUPV3_WRAP_2_S_AHB_CLK				126
137#define GCC_SDCC2_AHB_CLK					127
138#define GCC_SDCC2_APPS_CLK					128
139#define GCC_SDCC2_APPS_CLK_SRC					129
140#define GCC_SDCC4_AHB_CLK					130
141#define GCC_SDCC4_APPS_CLK					131
142#define GCC_SDCC4_APPS_CLK_SRC					132
143#define GCC_SYS_NOC_CPUSS_AHB_CLK				133
144#define GCC_TSIF_AHB_CLK					134
145#define GCC_TSIF_INACTIVITY_TIMERS_CLK				135
146#define GCC_TSIF_REF_CLK					136
147#define GCC_TSIF_REF_CLK_SRC					137
148#define GCC_UFS_CARD_AHB_CLK					138
149#define GCC_UFS_CARD_AXI_CLK					139
150#define GCC_UFS_CARD_AXI_CLK_SRC				140
151#define GCC_UFS_CARD_AXI_HW_CTL_CLK				141
152#define GCC_UFS_CARD_CLKREF_CLK					142
153#define GCC_UFS_CARD_ICE_CORE_CLK				143
154#define GCC_UFS_CARD_ICE_CORE_CLK_SRC				144
155#define GCC_UFS_CARD_ICE_CORE_HW_CTL_CLK			145
156#define GCC_UFS_CARD_PHY_AUX_CLK				146
157#define GCC_UFS_CARD_PHY_AUX_CLK_SRC				147
158#define GCC_UFS_CARD_PHY_AUX_HW_CTL_CLK				148
159#define GCC_UFS_CARD_RX_SYMBOL_0_CLK				149
160#define GCC_UFS_CARD_RX_SYMBOL_1_CLK				150
161#define GCC_UFS_CARD_TX_SYMBOL_0_CLK				151
162#define GCC_UFS_CARD_UNIPRO_CORE_CLK				152
163#define GCC_UFS_CARD_UNIPRO_CORE_CLK_SRC			153
164#define GCC_UFS_CARD_UNIPRO_CORE_HW_CTL_CLK			154
165#define GCC_UFS_MEM_CLKREF_CLK					155
166#define GCC_UFS_PHY_AHB_CLK					156
167#define GCC_UFS_PHY_AXI_CLK					157
168#define GCC_UFS_PHY_AXI_CLK_SRC					158
169#define GCC_UFS_PHY_AXI_HW_CTL_CLK				159
170#define GCC_UFS_PHY_ICE_CORE_CLK				160
171#define GCC_UFS_PHY_ICE_CORE_CLK_SRC				161
172#define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK				162
173#define GCC_UFS_PHY_PHY_AUX_CLK					163
174#define GCC_UFS_PHY_PHY_AUX_CLK_SRC				164
175#define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK				165
176#define GCC_UFS_PHY_RX_SYMBOL_0_CLK				166
177#define GCC_UFS_PHY_RX_SYMBOL_1_CLK				167
178#define GCC_UFS_PHY_TX_SYMBOL_0_CLK				168
179#define GCC_UFS_PHY_UNIPRO_CORE_CLK				169
180#define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC				170
181#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK			171
182#define GCC_USB30_PRIM_MASTER_CLK				172
183#define GCC_USB30_PRIM_MASTER_CLK_SRC				173
184#define GCC_USB30_PRIM_MOCK_UTMI_CLK				174
185#define GCC_USB30_PRIM_MOCK_UTMI_CLK_SRC			175
186#define GCC_USB30_PRIM_SLEEP_CLK				176
187#define GCC_USB30_SEC_MASTER_CLK				177
188#define GCC_USB30_SEC_MASTER_CLK_SRC				178
189#define GCC_USB30_SEC_MOCK_UTMI_CLK				179
190#define GCC_USB30_SEC_MOCK_UTMI_CLK_SRC				180
191#define GCC_USB30_SEC_SLEEP_CLK					181
192#define GCC_USB3_PRIM_CLKREF_CLK				182
193#define GCC_USB3_PRIM_PHY_AUX_CLK				183
194#define GCC_USB3_PRIM_PHY_AUX_CLK_SRC				184
195#define GCC_USB3_PRIM_PHY_COM_AUX_CLK				185
196#define GCC_USB3_PRIM_PHY_PIPE_CLK				186
197#define GCC_USB3_SEC_CLKREF_CLK					187
198#define GCC_USB3_SEC_PHY_AUX_CLK				188
199#define GCC_USB3_SEC_PHY_AUX_CLK_SRC				189
200#define GCC_USB3_SEC_PHY_COM_AUX_CLK				190
201#define GCC_USB3_SEC_PHY_PIPE_CLK				191
202#define GCC_VIDEO_AHB_CLK					192
203#define GCC_VIDEO_AXI0_CLK					193
204#define GCC_VIDEO_AXI1_CLK					194
205#define GCC_VIDEO_AXIC_CLK					195
206#define GCC_VIDEO_XO_CLK					196
207#define GPLL0							197
208#define GPLL0_OUT_EVEN						198
209#define GPLL7							199
210#define GPLL9							200
211
212/* Reset clocks */
213#define GCC_EMAC_BCR						0
214#define GCC_GPU_BCR						1
215#define GCC_MMSS_BCR						2
216#define GCC_NPU_BCR						3
217#define GCC_PCIE_0_BCR						4
218#define GCC_PCIE_0_PHY_BCR					5
219#define GCC_PCIE_1_BCR						6
220#define GCC_PCIE_1_PHY_BCR					7
221#define GCC_PCIE_PHY_BCR					8
222#define GCC_PDM_BCR						9
223#define GCC_PRNG_BCR						10
224#define GCC_QSPI_BCR						11
225#define GCC_QUPV3_WRAPPER_0_BCR					12
226#define GCC_QUPV3_WRAPPER_1_BCR					13
227#define GCC_QUPV3_WRAPPER_2_BCR					14
228#define GCC_QUSB2PHY_PRIM_BCR					15
229#define GCC_QUSB2PHY_SEC_BCR					16
230#define GCC_USB3_PHY_PRIM_BCR					17
231#define GCC_USB3_DP_PHY_PRIM_BCR				18
232#define GCC_USB3_PHY_SEC_BCR					19
233#define GCC_USB3PHY_PHY_SEC_BCR					20
234#define GCC_SDCC2_BCR						21
235#define GCC_SDCC4_BCR						22
236#define GCC_TSIF_BCR						23
237#define GCC_UFS_CARD_BCR					24
238#define GCC_UFS_PHY_BCR						25
239#define GCC_USB30_PRIM_BCR					26
240#define GCC_USB30_SEC_BCR					27
241#define GCC_USB_PHY_CFG_AHB2PHY_BCR				28
242
243/* GCC GDSCRs */
244#define USB30_PRIM_GDSC                     4
245#define USB30_SEC_GDSC						5
246
247#endif
248