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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/arch/mips/ddb5xxx/ddb5477/ |
| H A D | irq.c | 60 #define INTE 4 macro
99 set_pci_int_attr(PCI0, INTE, ACTIVE_LOW, LEVEL_SENSE);
105 set_pci_int_attr(PCI1, INTE, ACTIVE_LOW, LEVEL_SENSE);
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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/drivers/net/ |
| H A D | depca.h | 66 #define INTE 0xfff0 /* Interrupt Enable */ macro
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| H A D | depca.c | 994 outw(csr0 & INTE, DEPCA_DATA);
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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/sound/pci/emu10k1/ |
| H A D | io.c | 280 enable = inl(emu->port + INTE) | intrenb;
281 outl(enable, emu->port + INTE);
291 enable = inl(emu->port + INTE) & ~intrenb;
292 outl(enable, emu->port + INTE);
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| H A D | emu10k1x.c | 85 #define INTE 0x0c /* Interrupt enable register */ macro
334 enable = inl(emu->port + INTE) | intrenb;
335 outl(enable, emu->port + INTE);
345 enable = inl(emu->port + INTE) & ~intrenb;
346 outl(enable, emu->port + INTE);
748 outl(0, chip->port + INTE);
945 outl(0, chip->port + INTE);
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| H A D | emu10k1_main.c | 167 outl(0, emu->port + INTE);
381 outl(0, emu->port + INTE);
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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/sound/oss/emu10k1/ |
| H A D | hwaccess.c | 299 val = inl(card->iobase + INTE) | irq_mask;
300 outl(val, card->iobase + INTE);
313 val = inl(card->iobase + INTE) & ~irq_mask;
314 outl(val, card->iobase + INTE);
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| H A D | 8010.h | 104 #define INTE 0x0c /* Interrupt enable register */ macro
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| H A D | main.c | 962 emu10k1_writefn0(card, INTE, 0);
1206 emu10k1_writefn0(card, INTE, 0);
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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/sound/pci/ca0106/ |
| H A D | ca0106_main.c | 409 enable = inl(emu->port + INTE) | intrenb;
410 outl(enable, emu->port + INTE);
420 enable = inl(emu->port + INTE) & ~intrenb;
421 outl(enable, emu->port + INTE);
1024 outl(0, chip->port + INTE);
1298 outl(0, chip->port + INTE);
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| H A D | ca0106.h | 104 #define INTE 0x0c /* Interrupt enable register */ macro
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| /netgear-WNDR4500v2-V1.0.0.60_1.0.38/src/linux/linux-2.6/include/sound/ |
| H A D | emu10k1.h | 83 which INTE bits enable it) */
117 #define INTE 0x0c /* Interrupt enable register */ macro
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