1/* SPDX-License-Identifier: GPL-2.0-only */
2/*
3 * Copyright (c) 2015, The Linux Foundation. All rights reserved.
4 */
5
6#ifndef _DT_BINDINGS_CLK_MSM_GCC_8996_H
7#define _DT_BINDINGS_CLK_MSM_GCC_8996_H
8
9#define GPLL0_EARLY						0
10#define GPLL0							1
11#define GPLL1_EARLY						2
12#define GPLL1							3
13#define GPLL2_EARLY						4
14#define GPLL2							5
15#define GPLL3_EARLY						6
16#define GPLL3							7
17#define GPLL4_EARLY						8
18#define GPLL4							9
19#define SYSTEM_NOC_CLK_SRC					10
20/* U-Boot: KConfig check in CI erroneously picks this up, it's unused
21 * anyway so comment it out for now
22 */
23//#define CONFIG _NOC_CLK_SRC					11
24#define PERIPH_NOC_CLK_SRC					12
25#define MMSS_BIMC_GFX_CLK_SRC					13
26#define USB30_MASTER_CLK_SRC					14
27#define USB30_MOCK_UTMI_CLK_SRC					15
28#define USB3_PHY_AUX_CLK_SRC					16
29#define USB20_MASTER_CLK_SRC					17
30#define USB20_MOCK_UTMI_CLK_SRC					18
31#define SDCC1_APPS_CLK_SRC					19
32#define SDCC1_ICE_CORE_CLK_SRC					20
33#define SDCC2_APPS_CLK_SRC					21
34#define SDCC3_APPS_CLK_SRC					22
35#define SDCC4_APPS_CLK_SRC					23
36#define BLSP1_QUP1_SPI_APPS_CLK_SRC				24
37#define BLSP1_QUP1_I2C_APPS_CLK_SRC				25
38#define BLSP1_UART1_APPS_CLK_SRC				26
39#define BLSP1_QUP2_SPI_APPS_CLK_SRC				27
40#define BLSP1_QUP2_I2C_APPS_CLK_SRC				28
41#define BLSP1_UART2_APPS_CLK_SRC				29
42#define BLSP1_QUP3_SPI_APPS_CLK_SRC				30
43#define BLSP1_QUP3_I2C_APPS_CLK_SRC				31
44#define BLSP1_UART3_APPS_CLK_SRC				32
45#define BLSP1_QUP4_SPI_APPS_CLK_SRC				33
46#define BLSP1_QUP4_I2C_APPS_CLK_SRC				34
47#define BLSP1_UART4_APPS_CLK_SRC				35
48#define BLSP1_QUP5_SPI_APPS_CLK_SRC				36
49#define BLSP1_QUP5_I2C_APPS_CLK_SRC				37
50#define BLSP1_UART5_APPS_CLK_SRC				38
51#define BLSP1_QUP6_SPI_APPS_CLK_SRC				39
52#define BLSP1_QUP6_I2C_APPS_CLK_SRC				40
53#define BLSP1_UART6_APPS_CLK_SRC				41
54#define BLSP2_QUP1_SPI_APPS_CLK_SRC				42
55#define BLSP2_QUP1_I2C_APPS_CLK_SRC				43
56#define BLSP2_UART1_APPS_CLK_SRC				44
57#define BLSP2_QUP2_SPI_APPS_CLK_SRC				45
58#define BLSP2_QUP2_I2C_APPS_CLK_SRC				46
59#define BLSP2_UART2_APPS_CLK_SRC				47
60#define BLSP2_QUP3_SPI_APPS_CLK_SRC				48
61#define BLSP2_QUP3_I2C_APPS_CLK_SRC				49
62#define BLSP2_UART3_APPS_CLK_SRC				50
63#define BLSP2_QUP4_SPI_APPS_CLK_SRC				51
64#define BLSP2_QUP4_I2C_APPS_CLK_SRC				52
65#define BLSP2_UART4_APPS_CLK_SRC				53
66#define BLSP2_QUP5_SPI_APPS_CLK_SRC				54
67#define BLSP2_QUP5_I2C_APPS_CLK_SRC				55
68#define BLSP2_UART5_APPS_CLK_SRC				56
69#define BLSP2_QUP6_SPI_APPS_CLK_SRC				57
70#define BLSP2_QUP6_I2C_APPS_CLK_SRC				58
71#define BLSP2_UART6_APPS_CLK_SRC				59
72#define PDM2_CLK_SRC						60
73#define TSIF_REF_CLK_SRC					61
74#define CE1_CLK_SRC						62
75#define GCC_SLEEP_CLK_SRC					63
76#define BIMC_CLK_SRC						64
77#define HMSS_AHB_CLK_SRC					65
78#define BIMC_HMSS_AXI_CLK_SRC					66
79#define HMSS_RBCPR_CLK_SRC					67
80#define HMSS_GPLL0_CLK_SRC					68
81#define GP1_CLK_SRC						69
82#define GP2_CLK_SRC						70
83#define GP3_CLK_SRC						71
84#define PCIE_AUX_CLK_SRC					72
85#define UFS_AXI_CLK_SRC						73
86#define UFS_ICE_CORE_CLK_SRC					74
87#define QSPI_SER_CLK_SRC					75
88#define GCC_SYS_NOC_AXI_CLK					76
89#define GCC_SYS_NOC_HMSS_AHB_CLK				77
90#define GCC_SNOC_CNOC_AHB_CLK					78
91#define GCC_SNOC_PNOC_AHB_CLK					79
92#define GCC_SYS_NOC_AT_CLK					80
93#define GCC_SYS_NOC_USB3_AXI_CLK				81
94#define GCC_SYS_NOC_UFS_AXI_CLK					82
95#define GCC_CFG_NOC_AHB_CLK					83
96#define GCC_PERIPH_NOC_AHB_CLK					84
97#define GCC_PERIPH_NOC_USB20_AHB_CLK				85
98#define GCC_TIC_CLK						86
99#define GCC_IMEM_AXI_CLK					87
100#define GCC_MMSS_SYS_NOC_AXI_CLK				88
101#define GCC_MMSS_NOC_CFG_AHB_CLK				89
102#define GCC_MMSS_BIMC_GFX_CLK					90
103#define GCC_USB30_MASTER_CLK					91
104#define GCC_USB30_SLEEP_CLK					92
105#define GCC_USB30_MOCK_UTMI_CLK					93
106#define GCC_USB3_PHY_AUX_CLK					94
107#define GCC_USB3_PHY_PIPE_CLK					95
108#define GCC_USB20_MASTER_CLK					96
109#define GCC_USB20_SLEEP_CLK					97
110#define GCC_USB20_MOCK_UTMI_CLK					98
111#define GCC_USB_PHY_CFG_AHB2PHY_CLK				99
112#define GCC_SDCC1_APPS_CLK					100
113#define GCC_SDCC1_AHB_CLK					101
114#define GCC_SDCC1_ICE_CORE_CLK					102
115#define GCC_SDCC2_APPS_CLK					103
116#define GCC_SDCC2_AHB_CLK					104
117#define GCC_SDCC3_APPS_CLK					105
118#define GCC_SDCC3_AHB_CLK					106
119#define GCC_SDCC4_APPS_CLK					107
120#define GCC_SDCC4_AHB_CLK					108
121#define GCC_BLSP1_AHB_CLK					109
122#define GCC_BLSP1_SLEEP_CLK					110
123#define GCC_BLSP1_QUP1_SPI_APPS_CLK				111
124#define GCC_BLSP1_QUP1_I2C_APPS_CLK				112
125#define GCC_BLSP1_UART1_APPS_CLK				113
126#define GCC_BLSP1_QUP2_SPI_APPS_CLK				114
127#define GCC_BLSP1_QUP2_I2C_APPS_CLK				115
128#define GCC_BLSP1_UART2_APPS_CLK				116
129#define GCC_BLSP1_QUP3_SPI_APPS_CLK				117
130#define GCC_BLSP1_QUP3_I2C_APPS_CLK				118
131#define GCC_BLSP1_UART3_APPS_CLK				119
132#define GCC_BLSP1_QUP4_SPI_APPS_CLK				120
133#define GCC_BLSP1_QUP4_I2C_APPS_CLK				121
134#define GCC_BLSP1_UART4_APPS_CLK				122
135#define GCC_BLSP1_QUP5_SPI_APPS_CLK				123
136#define GCC_BLSP1_QUP5_I2C_APPS_CLK				124
137#define GCC_BLSP1_UART5_APPS_CLK				125
138#define GCC_BLSP1_QUP6_SPI_APPS_CLK				126
139#define GCC_BLSP1_QUP6_I2C_APPS_CLK				127
140#define GCC_BLSP1_UART6_APPS_CLK				128
141#define GCC_BLSP2_AHB_CLK					129
142#define GCC_BLSP2_SLEEP_CLK					130
143#define GCC_BLSP2_QUP1_SPI_APPS_CLK				131
144#define GCC_BLSP2_QUP1_I2C_APPS_CLK				132
145#define GCC_BLSP2_UART1_APPS_CLK				133
146#define GCC_BLSP2_QUP2_SPI_APPS_CLK				134
147#define GCC_BLSP2_QUP2_I2C_APPS_CLK				135
148#define GCC_BLSP2_UART2_APPS_CLK				136
149#define GCC_BLSP2_QUP3_SPI_APPS_CLK				137
150#define GCC_BLSP2_QUP3_I2C_APPS_CLK				138
151#define GCC_BLSP2_UART3_APPS_CLK				139
152#define GCC_BLSP2_QUP4_SPI_APPS_CLK				140
153#define GCC_BLSP2_QUP4_I2C_APPS_CLK				141
154#define GCC_BLSP2_UART4_APPS_CLK				142
155#define GCC_BLSP2_QUP5_SPI_APPS_CLK				143
156#define GCC_BLSP2_QUP5_I2C_APPS_CLK				144
157#define GCC_BLSP2_UART5_APPS_CLK				145
158#define GCC_BLSP2_QUP6_SPI_APPS_CLK				146
159#define GCC_BLSP2_QUP6_I2C_APPS_CLK				147
160#define GCC_BLSP2_UART6_APPS_CLK				148
161#define GCC_PDM_AHB_CLK						149
162#define GCC_PDM_XO4_CLK						150
163#define GCC_PDM2_CLK						151
164#define GCC_PRNG_AHB_CLK					152
165#define GCC_TSIF_AHB_CLK					153
166#define GCC_TSIF_REF_CLK					154
167#define GCC_TSIF_INACTIVITY_TIMERS_CLK				155
168#define GCC_TCSR_AHB_CLK					156
169#define GCC_BOOT_ROM_AHB_CLK					157
170#define GCC_MSG_RAM_AHB_CLK					158
171#define GCC_TLMM_AHB_CLK					159
172#define GCC_TLMM_CLK						160
173#define GCC_MPM_AHB_CLK						161
174#define GCC_SPMI_SER_CLK					162
175#define GCC_SPMI_CNOC_AHB_CLK					163
176#define GCC_CE1_CLK						164
177#define GCC_CE1_AXI_CLK						165
178#define GCC_CE1_AHB_CLK						166
179#define GCC_BIMC_HMSS_AXI_CLK					167
180#define GCC_BIMC_GFX_CLK					168
181#define GCC_HMSS_AHB_CLK					169
182#define GCC_HMSS_SLV_AXI_CLK					170
183#define GCC_HMSS_MSTR_AXI_CLK					171
184#define GCC_HMSS_RBCPR_CLK					172
185#define GCC_GP1_CLK						173
186#define GCC_GP2_CLK						174
187#define GCC_GP3_CLK						175
188#define GCC_PCIE_0_SLV_AXI_CLK					176
189#define GCC_PCIE_0_MSTR_AXI_CLK					177
190#define GCC_PCIE_0_CFG_AHB_CLK					178
191#define GCC_PCIE_0_AUX_CLK					179
192#define GCC_PCIE_0_PIPE_CLK					180
193#define GCC_PCIE_1_SLV_AXI_CLK					181
194#define GCC_PCIE_1_MSTR_AXI_CLK					182
195#define GCC_PCIE_1_CFG_AHB_CLK					183
196#define GCC_PCIE_1_AUX_CLK					184
197#define GCC_PCIE_1_PIPE_CLK					185
198#define GCC_PCIE_2_SLV_AXI_CLK					186
199#define GCC_PCIE_2_MSTR_AXI_CLK					187
200#define GCC_PCIE_2_CFG_AHB_CLK					188
201#define GCC_PCIE_2_AUX_CLK					189
202#define GCC_PCIE_2_PIPE_CLK					190
203#define GCC_PCIE_PHY_CFG_AHB_CLK				191
204#define GCC_PCIE_PHY_AUX_CLK					192
205#define GCC_UFS_AXI_CLK						193
206#define GCC_UFS_AHB_CLK						194
207#define GCC_UFS_TX_CFG_CLK					195
208#define GCC_UFS_RX_CFG_CLK					196
209#define GCC_UFS_TX_SYMBOL_0_CLK					197
210#define GCC_UFS_RX_SYMBOL_0_CLK					198
211#define GCC_UFS_RX_SYMBOL_1_CLK					199
212#define GCC_UFS_UNIPRO_CORE_CLK					200
213#define GCC_UFS_ICE_CORE_CLK					201
214#define GCC_UFS_SYS_CLK_CORE_CLK				202
215#define GCC_UFS_TX_SYMBOL_CLK_CORE_CLK				203
216#define GCC_AGGRE0_SNOC_AXI_CLK					204
217#define GCC_AGGRE0_CNOC_AHB_CLK					205
218#define GCC_SMMU_AGGRE0_AXI_CLK					206
219#define GCC_SMMU_AGGRE0_AHB_CLK					207
220#define GCC_AGGRE1_PNOC_AHB_CLK					208
221#define GCC_AGGRE2_UFS_AXI_CLK					209
222#define GCC_AGGRE2_USB3_AXI_CLK					210
223#define GCC_QSPI_AHB_CLK					211
224#define GCC_QSPI_SER_CLK					212
225#define GCC_USB3_CLKREF_CLK					213
226#define GCC_HDMI_CLKREF_CLK					214
227#define GCC_UFS_CLKREF_CLK					215
228#define GCC_PCIE_CLKREF_CLK					216
229#define GCC_RX2_USB2_CLKREF_CLK					217
230#define GCC_RX1_USB2_CLKREF_CLK					218
231#define GCC_HLOS1_VOTE_LPASS_CORE_SMMU_CLK			219
232#define GCC_HLOS1_VOTE_LPASS_ADSP_SMMU_CLK			220
233#define GCC_EDP_CLKREF_CLK					221
234#define GCC_MSS_CFG_AHB_CLK					222
235#define GCC_MSS_Q6_BIMC_AXI_CLK					223
236#define GCC_MSS_SNOC_AXI_CLK					224
237#define GCC_MSS_MNOC_BIMC_AXI_CLK				225
238#define GCC_DCC_AHB_CLK						226
239#define GCC_AGGRE0_NOC_MPU_CFG_AHB_CLK				227
240#define GCC_MMSS_GPLL0_DIV_CLK					228
241#define GCC_MSS_GPLL0_DIV_CLK					229
242
243#define GCC_SYSTEM_NOC_BCR					0
244#define GCC_CONFIG_NOC_BCR					1
245#define GCC_PERIPH_NOC_BCR					2
246#define GCC_IMEM_BCR						3
247#define GCC_MMSS_BCR						4
248#define GCC_PIMEM_BCR						5
249#define GCC_QDSS_BCR						6
250#define GCC_USB_30_BCR						7
251#define GCC_USB_20_BCR						8
252#define GCC_QUSB2PHY_PRIM_BCR					9
253#define GCC_QUSB2PHY_SEC_BCR					10
254#define GCC_USB_PHY_CFG_AHB2PHY_BCR				11
255#define GCC_SDCC1_BCR						12
256#define GCC_SDCC2_BCR						13
257#define GCC_SDCC3_BCR						14
258#define GCC_SDCC4_BCR						15
259#define GCC_BLSP1_BCR						16
260#define GCC_BLSP1_QUP1_BCR					17
261#define GCC_BLSP1_UART1_BCR					18
262#define GCC_BLSP1_QUP2_BCR					19
263#define GCC_BLSP1_UART2_BCR					20
264#define GCC_BLSP1_QUP3_BCR					21
265#define GCC_BLSP1_UART3_BCR					22
266#define GCC_BLSP1_QUP4_BCR					23
267#define GCC_BLSP1_UART4_BCR					24
268#define GCC_BLSP1_QUP5_BCR					25
269#define GCC_BLSP1_UART5_BCR					26
270#define GCC_BLSP1_QUP6_BCR					27
271#define GCC_BLSP1_UART6_BCR					28
272#define GCC_BLSP2_BCR						29
273#define GCC_BLSP2_QUP1_BCR					30
274#define GCC_BLSP2_UART1_BCR					31
275#define GCC_BLSP2_QUP2_BCR					32
276#define GCC_BLSP2_UART2_BCR					33
277#define GCC_BLSP2_QUP3_BCR					34
278#define GCC_BLSP2_UART3_BCR					35
279#define GCC_BLSP2_QUP4_BCR					36
280#define GCC_BLSP2_UART4_BCR					37
281#define GCC_BLSP2_QUP5_BCR					38
282#define GCC_BLSP2_UART5_BCR					39
283#define GCC_BLSP2_QUP6_BCR					40
284#define GCC_BLSP2_UART6_BCR					41
285#define GCC_PDM_BCR						42
286#define GCC_PRNG_BCR						43
287#define GCC_TSIF_BCR						44
288#define GCC_TCSR_BCR						45
289#define GCC_BOOT_ROM_BCR					46
290#define GCC_MSG_RAM_BCR						47
291#define GCC_TLMM_BCR						48
292#define GCC_MPM_BCR						49
293#define GCC_SEC_CTRL_BCR					50
294#define GCC_SPMI_BCR						51
295#define GCC_SPDM_BCR						52
296#define GCC_CE1_BCR						53
297#define GCC_BIMC_BCR						54
298#define GCC_SNOC_BUS_TIMEOUT0_BCR				55
299#define GCC_SNOC_BUS_TIMEOUT2_BCR				56
300#define GCC_SNOC_BUS_TIMEOUT1_BCR				57
301#define GCC_SNOC_BUS_TIMEOUT3_BCR				58
302#define GCC_SNOC_BUS_TIMEOUT_EXTREF_BCR				59
303#define GCC_PNOC_BUS_TIMEOUT0_BCR				60
304#define GCC_PNOC_BUS_TIMEOUT1_BCR				61
305#define GCC_PNOC_BUS_TIMEOUT2_BCR				62
306#define GCC_PNOC_BUS_TIMEOUT3_BCR				63
307#define GCC_PNOC_BUS_TIMEOUT4_BCR				64
308#define GCC_CNOC_BUS_TIMEOUT0_BCR				65
309#define GCC_CNOC_BUS_TIMEOUT1_BCR				66
310#define GCC_CNOC_BUS_TIMEOUT2_BCR				67
311#define GCC_CNOC_BUS_TIMEOUT3_BCR				68
312#define GCC_CNOC_BUS_TIMEOUT4_BCR				69
313#define GCC_CNOC_BUS_TIMEOUT5_BCR				70
314#define GCC_CNOC_BUS_TIMEOUT6_BCR				71
315#define GCC_CNOC_BUS_TIMEOUT7_BCR				72
316#define GCC_CNOC_BUS_TIMEOUT8_BCR				73
317#define GCC_CNOC_BUS_TIMEOUT9_BCR				74
318#define GCC_CNOC_BUS_TIMEOUT_EXTREF_BCR				75
319#define GCC_APB2JTAG_BCR					76
320#define GCC_RBCPR_CX_BCR					77
321#define GCC_RBCPR_MX_BCR					78
322#define GCC_PCIE_0_BCR						79
323#define GCC_PCIE_0_PHY_BCR					80
324#define GCC_PCIE_1_BCR						81
325#define GCC_PCIE_1_PHY_BCR					82
326#define GCC_PCIE_2_BCR						83
327#define GCC_PCIE_2_PHY_BCR					84
328#define GCC_PCIE_PHY_BCR					85
329#define GCC_DCD_BCR						86
330#define GCC_OBT_ODT_BCR						87
331#define GCC_UFS_BCR						88
332#define GCC_SSC_BCR						89
333#define GCC_VS_BCR						90
334#define GCC_AGGRE0_NOC_BCR					91
335#define GCC_AGGRE1_NOC_BCR					92
336#define GCC_AGGRE2_NOC_BCR					93
337#define GCC_DCC_BCR						94
338#define GCC_IPA_BCR						95
339#define GCC_QSPI_BCR						96
340#define GCC_SKL_BCR						97
341#define GCC_MSMPU_BCR						98
342#define GCC_MSS_Q6_BCR						99
343#define GCC_QREFS_VBG_CAL_BCR					100
344#define GCC_PCIE_PHY_COM_BCR					101
345#define GCC_PCIE_PHY_COM_NOCSR_BCR				102
346#define GCC_USB3_PHY_BCR					103
347#define GCC_USB3PHY_PHY_BCR					104
348#define GCC_MSS_RESTART						105
349
350
351/* Indexes for GDSCs */
352#define AGGRE0_NOC_GDSC			0
353#define HLOS1_VOTE_AGGRE0_NOC_GDSC	1
354#define HLOS1_VOTE_LPASS_ADSP_GDSC	2
355#define HLOS1_VOTE_LPASS_CORE_GDSC	3
356#define USB30_GDSC			4
357#define PCIE0_GDSC			5
358#define PCIE1_GDSC			6
359#define PCIE2_GDSC			7
360#define UFS_GDSC			8
361
362#endif
363