1/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
2/*
3 * Copyright (c) 2022 Qualcomm Innovation Center, Inc. All rights reserved.
4 */
5
6#ifndef _DT_BINDINGS_CLK_QCOM_GCC_IPQ5332_H
7#define _DT_BINDINGS_CLK_QCOM_GCC_IPQ5332_H
8
9#define GPLL0_MAIN					0
10#define GPLL0						1
11#define GPLL2_MAIN					2
12#define GPLL2						3
13#define GPLL4_MAIN					4
14#define GPLL4						5
15#define GCC_ADSS_PWM_CLK				6
16#define GCC_ADSS_PWM_CLK_SRC				7
17#define GCC_AHB_CLK					8
18#define GCC_APSS_AXI_CLK_SRC				9
19#define GCC_BLSP1_AHB_CLK				10
20#define GCC_BLSP1_QUP1_I2C_APPS_CLK			11
21#define GCC_BLSP1_QUP1_SPI_APPS_CLK			12
22#define GCC_BLSP1_QUP1_SPI_APPS_CLK_SRC			13
23#define GCC_BLSP1_QUP2_I2C_APPS_CLK			14
24#define GCC_BLSP1_QUP2_SPI_APPS_CLK			15
25#define GCC_BLSP1_QUP2_SPI_APPS_CLK_SRC			16
26#define GCC_BLSP1_QUP3_I2C_APPS_CLK			17
27#define GCC_BLSP1_QUP3_SPI_APPS_CLK			18
28#define GCC_BLSP1_QUP3_SPI_APPS_CLK_SRC			19
29#define GCC_BLSP1_SLEEP_CLK				20
30#define GCC_BLSP1_UART1_APPS_CLK			21
31#define GCC_BLSP1_UART1_APPS_CLK_SRC			22
32#define GCC_BLSP1_UART2_APPS_CLK			23
33#define GCC_BLSP1_UART2_APPS_CLK_SRC			24
34#define GCC_BLSP1_UART3_APPS_CLK			25
35#define GCC_BLSP1_UART3_APPS_CLK_SRC			26
36#define GCC_CE_AHB_CLK					27
37#define GCC_CE_AXI_CLK					28
38#define GCC_CE_PCNOC_AHB_CLK				29
39#define GCC_CMN_12GPLL_AHB_CLK				30
40#define GCC_CMN_12GPLL_APU_CLK				31
41#define GCC_CMN_12GPLL_SYS_CLK				32
42#define GCC_GP1_CLK					33
43#define GCC_GP1_CLK_SRC					34
44#define GCC_GP2_CLK					35
45#define GCC_GP2_CLK_SRC					36
46#define GCC_LPASS_CORE_AXIM_CLK				37
47#define GCC_LPASS_SWAY_CLK				38
48#define GCC_LPASS_SWAY_CLK_SRC				39
49#define GCC_MDIO_AHB_CLK				40
50#define GCC_MDIO_SLAVE_AHB_CLK				41
51#define GCC_MEM_NOC_Q6_AXI_CLK				42
52#define GCC_MEM_NOC_TS_CLK				43
53#define GCC_NSS_TS_CLK					44
54#define GCC_NSS_TS_CLK_SRC				45
55#define GCC_NSSCC_CLK					46
56#define GCC_NSSCFG_CLK					47
57#define GCC_NSSNOC_ATB_CLK				48
58#define GCC_NSSNOC_NSSCC_CLK				49
59#define GCC_NSSNOC_QOSGEN_REF_CLK			50
60#define GCC_NSSNOC_SNOC_1_CLK				51
61#define GCC_NSSNOC_SNOC_CLK				52
62#define GCC_NSSNOC_TIMEOUT_REF_CLK			53
63#define GCC_NSSNOC_XO_DCD_CLK				54
64#define GCC_PCIE3X1_0_AHB_CLK				55
65#define GCC_PCIE3X1_0_AUX_CLK				56
66#define GCC_PCIE3X1_0_AXI_CLK_SRC			57
67#define GCC_PCIE3X1_0_AXI_M_CLK				58
68#define GCC_PCIE3X1_0_AXI_S_BRIDGE_CLK			59
69#define GCC_PCIE3X1_0_AXI_S_CLK				60
70#define GCC_PCIE3X1_0_PIPE_CLK				61
71#define GCC_PCIE3X1_0_RCHG_CLK				62
72#define GCC_PCIE3X1_0_RCHG_CLK_SRC			63
73#define GCC_PCIE3X1_1_AHB_CLK				64
74#define GCC_PCIE3X1_1_AUX_CLK				65
75#define GCC_PCIE3X1_1_AXI_CLK_SRC			66
76#define GCC_PCIE3X1_1_AXI_M_CLK				67
77#define GCC_PCIE3X1_1_AXI_S_BRIDGE_CLK			68
78#define GCC_PCIE3X1_1_AXI_S_CLK				69
79#define GCC_PCIE3X1_1_PIPE_CLK				70
80#define GCC_PCIE3X1_1_RCHG_CLK				71
81#define GCC_PCIE3X1_1_RCHG_CLK_SRC			72
82#define GCC_PCIE3X1_PHY_AHB_CLK				73
83#define GCC_PCIE3X2_AHB_CLK				74
84#define GCC_PCIE3X2_AUX_CLK				75
85#define GCC_PCIE3X2_AXI_M_CLK				76
86#define GCC_PCIE3X2_AXI_M_CLK_SRC			77
87#define GCC_PCIE3X2_AXI_S_BRIDGE_CLK			78
88#define GCC_PCIE3X2_AXI_S_CLK				79
89#define GCC_PCIE3X2_AXI_S_CLK_SRC			80
90#define GCC_PCIE3X2_PHY_AHB_CLK				81
91#define GCC_PCIE3X2_PIPE_CLK				82
92#define GCC_PCIE3X2_RCHG_CLK				83
93#define GCC_PCIE3X2_RCHG_CLK_SRC			84
94#define GCC_PCIE_AUX_CLK_SRC				85
95#define GCC_PCNOC_AT_CLK				86
96#define GCC_PCNOC_BFDCD_CLK_SRC				87
97#define GCC_PCNOC_LPASS_CLK				88
98#define GCC_PRNG_AHB_CLK				89
99#define GCC_Q6_AHB_CLK					90
100#define GCC_Q6_AHB_S_CLK				91
101#define GCC_Q6_AXIM_CLK					92
102#define GCC_Q6_AXIM_CLK_SRC				93
103#define GCC_Q6_AXIS_CLK					94
104#define GCC_Q6_TSCTR_1TO2_CLK				95
105#define GCC_Q6SS_ATBM_CLK				96
106#define GCC_Q6SS_PCLKDBG_CLK				97
107#define GCC_Q6SS_TRIG_CLK				98
108#define GCC_QDSS_AT_CLK					99
109#define GCC_QDSS_AT_CLK_SRC				100
110#define GCC_QDSS_CFG_AHB_CLK				101
111#define GCC_QDSS_DAP_AHB_CLK				102
112#define GCC_QDSS_DAP_CLK				103
113#define GCC_QDSS_DAP_DIV_CLK_SRC			104
114#define GCC_QDSS_ETR_USB_CLK				105
115#define GCC_QDSS_EUD_AT_CLK				106
116#define GCC_QDSS_TSCTR_CLK_SRC				107
117#define GCC_QPIC_AHB_CLK				108
118#define GCC_QPIC_CLK					109
119#define GCC_QPIC_IO_MACRO_CLK				110
120#define GCC_QPIC_IO_MACRO_CLK_SRC			111
121#define GCC_QPIC_SLEEP_CLK				112
122#define GCC_SDCC1_AHB_CLK				113
123#define GCC_SDCC1_APPS_CLK				114
124#define GCC_SDCC1_APPS_CLK_SRC				115
125#define GCC_SLEEP_CLK_SRC				116
126#define GCC_SNOC_LPASS_CFG_CLK				117
127#define GCC_SNOC_NSSNOC_1_CLK				118
128#define GCC_SNOC_NSSNOC_CLK				119
129#define GCC_SNOC_PCIE3_1LANE_1_M_CLK			120
130#define GCC_SNOC_PCIE3_1LANE_1_S_CLK			121
131#define GCC_SNOC_PCIE3_1LANE_M_CLK			122
132#define GCC_SNOC_PCIE3_1LANE_S_CLK			123
133#define GCC_SNOC_PCIE3_2LANE_M_CLK			124
134#define GCC_SNOC_PCIE3_2LANE_S_CLK			125
135#define GCC_SNOC_USB_CLK				126
136#define GCC_SYS_NOC_AT_CLK				127
137#define GCC_SYS_NOC_WCSS_AHB_CLK			128
138#define GCC_SYSTEM_NOC_BFDCD_CLK_SRC			129
139#define GCC_UNIPHY0_AHB_CLK				130
140#define GCC_UNIPHY0_SYS_CLK				131
141#define GCC_UNIPHY1_AHB_CLK				132
142#define GCC_UNIPHY1_SYS_CLK				133
143#define GCC_UNIPHY_SYS_CLK_SRC				134
144#define GCC_USB0_AUX_CLK				135
145#define GCC_USB0_AUX_CLK_SRC				136
146#define GCC_USB0_EUD_AT_CLK				137
147#define GCC_USB0_LFPS_CLK				138
148#define GCC_USB0_LFPS_CLK_SRC				139
149#define GCC_USB0_MASTER_CLK				140
150#define GCC_USB0_MASTER_CLK_SRC				141
151#define GCC_USB0_MOCK_UTMI_CLK				142
152#define GCC_USB0_MOCK_UTMI_CLK_SRC			143
153#define GCC_USB0_MOCK_UTMI_DIV_CLK_SRC			144
154#define GCC_USB0_PHY_CFG_AHB_CLK			145
155#define GCC_USB0_PIPE_CLK				146
156#define GCC_USB0_SLEEP_CLK				147
157#define GCC_WCSS_AHB_CLK_SRC				148
158#define GCC_WCSS_AXIM_CLK				149
159#define GCC_WCSS_AXIS_CLK				150
160#define GCC_WCSS_DBG_IFC_APB_BDG_CLK			151
161#define GCC_WCSS_DBG_IFC_APB_CLK			152
162#define GCC_WCSS_DBG_IFC_ATB_BDG_CLK			153
163#define GCC_WCSS_DBG_IFC_ATB_CLK			154
164#define GCC_WCSS_DBG_IFC_NTS_BDG_CLK			155
165#define GCC_WCSS_DBG_IFC_NTS_CLK			156
166#define GCC_WCSS_ECAHB_CLK				157
167#define GCC_WCSS_MST_ASYNC_BDG_CLK			158
168#define GCC_WCSS_SLV_ASYNC_BDG_CLK			159
169#define GCC_XO_CLK					160
170#define GCC_XO_CLK_SRC					161
171#define GCC_XO_DIV4_CLK					162
172#define GCC_IM_SLEEP_CLK				163
173#define GCC_NSSNOC_PCNOC_1_CLK				164
174#define GCC_MEM_NOC_AHB_CLK				165
175#define GCC_MEM_NOC_APSS_AXI_CLK			166
176#define GCC_SNOC_QOSGEN_EXTREF_DIV_CLK_SRC		167
177#define GCC_MEM_NOC_QOSGEN_EXTREF_CLK			168
178#define GCC_PCIE3X2_PIPE_CLK_SRC			169
179#define GCC_PCIE3X1_0_PIPE_CLK_SRC			170
180#define GCC_PCIE3X1_1_PIPE_CLK_SRC			171
181#define GCC_USB0_PIPE_CLK_SRC				172
182
183#define GCC_ADSS_BCR					0
184#define GCC_ADSS_PWM_CLK_ARES				1
185#define GCC_AHB_CLK_ARES				2
186#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_BCR		3
187#define GCC_APC0_VOLTAGE_DROOP_DETECTOR_GPLL0_CLK_ARES	4
188#define GCC_APSS_AHB_CLK_ARES				5
189#define GCC_APSS_AXI_CLK_ARES				6
190#define GCC_BLSP1_AHB_CLK_ARES				7
191#define GCC_BLSP1_BCR					8
192#define GCC_BLSP1_QUP1_BCR				9
193#define GCC_BLSP1_QUP1_I2C_APPS_CLK_ARES		10
194#define GCC_BLSP1_QUP1_SPI_APPS_CLK_ARES		11
195#define GCC_BLSP1_QUP2_BCR				12
196#define GCC_BLSP1_QUP2_I2C_APPS_CLK_ARES		13
197#define GCC_BLSP1_QUP2_SPI_APPS_CLK_ARES		14
198#define GCC_BLSP1_QUP3_BCR				15
199#define GCC_BLSP1_QUP3_I2C_APPS_CLK_ARES		16
200#define GCC_BLSP1_QUP3_SPI_APPS_CLK_ARES		17
201#define GCC_BLSP1_SLEEP_CLK_ARES			18
202#define GCC_BLSP1_UART1_APPS_CLK_ARES			19
203#define GCC_BLSP1_UART1_BCR				20
204#define GCC_BLSP1_UART2_APPS_CLK_ARES			21
205#define GCC_BLSP1_UART2_BCR				22
206#define GCC_BLSP1_UART3_APPS_CLK_ARES			23
207#define GCC_BLSP1_UART3_BCR				24
208#define GCC_CE_BCR					25
209#define GCC_CMN_BLK_BCR					26
210#define GCC_CMN_LDO0_BCR				27
211#define GCC_CMN_LDO1_BCR				28
212#define GCC_DCC_BCR					29
213#define GCC_GP1_CLK_ARES				30
214#define GCC_GP2_CLK_ARES				31
215#define GCC_LPASS_BCR					32
216#define GCC_LPASS_CORE_AXIM_CLK_ARES			33
217#define GCC_LPASS_SWAY_CLK_ARES				34
218#define GCC_MDIOM_BCR					35
219#define GCC_MDIOS_BCR					36
220#define GCC_NSS_BCR					37
221#define GCC_NSS_TS_CLK_ARES				38
222#define GCC_NSSCC_CLK_ARES				39
223#define GCC_NSSCFG_CLK_ARES				40
224#define GCC_NSSNOC_ATB_CLK_ARES				41
225#define GCC_NSSNOC_NSSCC_CLK_ARES			42
226#define GCC_NSSNOC_QOSGEN_REF_CLK_ARES			43
227#define GCC_NSSNOC_SNOC_1_CLK_ARES			44
228#define GCC_NSSNOC_SNOC_CLK_ARES			45
229#define GCC_NSSNOC_TIMEOUT_REF_CLK_ARES			46
230#define GCC_NSSNOC_XO_DCD_CLK_ARES			47
231#define GCC_PCIE3X1_0_AHB_CLK_ARES			48
232#define GCC_PCIE3X1_0_AUX_CLK_ARES			49
233#define GCC_PCIE3X1_0_AXI_M_CLK_ARES			50
234#define GCC_PCIE3X1_0_AXI_S_BRIDGE_CLK_ARES		51
235#define GCC_PCIE3X1_0_AXI_S_CLK_ARES			52
236#define GCC_PCIE3X1_0_BCR				53
237#define GCC_PCIE3X1_0_LINK_DOWN_BCR			54
238#define GCC_PCIE3X1_0_PHY_BCR				55
239#define GCC_PCIE3X1_0_PHY_PHY_BCR			56
240#define GCC_PCIE3X1_1_AHB_CLK_ARES			57
241#define GCC_PCIE3X1_1_AUX_CLK_ARES			58
242#define GCC_PCIE3X1_1_AXI_M_CLK_ARES			59
243#define GCC_PCIE3X1_1_AXI_S_BRIDGE_CLK_ARES		60
244#define GCC_PCIE3X1_1_AXI_S_CLK_ARES			61
245#define GCC_PCIE3X1_1_BCR				62
246#define GCC_PCIE3X1_1_LINK_DOWN_BCR			63
247#define GCC_PCIE3X1_1_PHY_BCR				64
248#define GCC_PCIE3X1_1_PHY_PHY_BCR			65
249#define GCC_PCIE3X1_PHY_AHB_CLK_ARES			66
250#define GCC_PCIE3X2_AHB_CLK_ARES			67
251#define GCC_PCIE3X2_AUX_CLK_ARES			68
252#define GCC_PCIE3X2_AXI_M_CLK_ARES			69
253#define GCC_PCIE3X2_AXI_S_BRIDGE_CLK_ARES		70
254#define GCC_PCIE3X2_AXI_S_CLK_ARES			71
255#define GCC_PCIE3X2_BCR					72
256#define GCC_PCIE3X2_LINK_DOWN_BCR			73
257#define GCC_PCIE3X2_PHY_AHB_CLK_ARES			74
258#define GCC_PCIE3X2_PHY_BCR				75
259#define GCC_PCIE3X2PHY_PHY_BCR				76
260#define GCC_PCNOC_BCR					77
261#define GCC_PCNOC_LPASS_CLK_ARES			78
262#define GCC_PRNG_AHB_CLK_ARES				79
263#define GCC_PRNG_BCR					80
264#define GCC_Q6_AHB_CLK_ARES				81
265#define GCC_Q6_AHB_S_CLK_ARES				82
266#define GCC_Q6_AXIM_CLK_ARES				83
267#define GCC_Q6_AXIS_CLK_ARES				84
268#define GCC_Q6_TSCTR_1TO2_CLK_ARES			85
269#define GCC_Q6SS_ATBM_CLK_ARES				86
270#define GCC_Q6SS_PCLKDBG_CLK_ARES			87
271#define GCC_Q6SS_TRIG_CLK_ARES				88
272#define GCC_QDSS_APB2JTAG_CLK_ARES			89
273#define GCC_QDSS_AT_CLK_ARES				90
274#define GCC_QDSS_BCR					91
275#define GCC_QDSS_CFG_AHB_CLK_ARES			92
276#define GCC_QDSS_DAP_AHB_CLK_ARES			93
277#define GCC_QDSS_DAP_CLK_ARES				94
278#define GCC_QDSS_ETR_USB_CLK_ARES			95
279#define GCC_QDSS_EUD_AT_CLK_ARES			96
280#define GCC_QDSS_STM_CLK_ARES				97
281#define GCC_QDSS_TRACECLKIN_CLK_ARES			98
282#define GCC_QDSS_TS_CLK_ARES				99
283#define GCC_QDSS_TSCTR_DIV16_CLK_ARES			100
284#define GCC_QDSS_TSCTR_DIV2_CLK_ARES			101
285#define GCC_QDSS_TSCTR_DIV3_CLK_ARES			102
286#define GCC_QDSS_TSCTR_DIV4_CLK_ARES			103
287#define GCC_QDSS_TSCTR_DIV8_CLK_ARES			104
288#define GCC_QPIC_AHB_CLK_ARES				105
289#define GCC_QPIC_CLK_ARES				106
290#define GCC_QPIC_BCR					107
291#define GCC_QPIC_IO_MACRO_CLK_ARES			108
292#define GCC_QPIC_SLEEP_CLK_ARES				109
293#define GCC_QUSB2_0_PHY_BCR				110
294#define GCC_SDCC1_AHB_CLK_ARES				111
295#define GCC_SDCC1_APPS_CLK_ARES				112
296#define GCC_SDCC_BCR					113
297#define GCC_SNOC_BCR					114
298#define GCC_SNOC_LPASS_CFG_CLK_ARES			115
299#define GCC_SNOC_NSSNOC_1_CLK_ARES			116
300#define GCC_SNOC_NSSNOC_CLK_ARES			117
301#define GCC_SYS_NOC_QDSS_STM_AXI_CLK_ARES		118
302#define GCC_SYS_NOC_WCSS_AHB_CLK_ARES			119
303#define GCC_UNIPHY0_AHB_CLK_ARES			120
304#define GCC_UNIPHY0_BCR					121
305#define GCC_UNIPHY0_SYS_CLK_ARES			122
306#define GCC_UNIPHY1_AHB_CLK_ARES			123
307#define GCC_UNIPHY1_BCR					124
308#define GCC_UNIPHY1_SYS_CLK_ARES			125
309#define GCC_USB0_AUX_CLK_ARES				126
310#define GCC_USB0_EUD_AT_CLK_ARES			127
311#define GCC_USB0_LFPS_CLK_ARES				128
312#define GCC_USB0_MASTER_CLK_ARES			129
313#define GCC_USB0_MOCK_UTMI_CLK_ARES			130
314#define GCC_USB0_PHY_BCR				131
315#define GCC_USB0_PHY_CFG_AHB_CLK_ARES			132
316#define GCC_USB0_SLEEP_CLK_ARES				133
317#define GCC_USB3PHY_0_PHY_BCR				134
318#define GCC_USB_BCR					135
319#define GCC_WCSS_AXIM_CLK_ARES				136
320#define GCC_WCSS_AXIS_CLK_ARES				137
321#define GCC_WCSS_BCR					138
322#define GCC_WCSS_DBG_IFC_APB_BDG_CLK_ARES		139
323#define GCC_WCSS_DBG_IFC_APB_CLK_ARES			140
324#define GCC_WCSS_DBG_IFC_ATB_BDG_CLK_ARES		141
325#define GCC_WCSS_DBG_IFC_ATB_CLK_ARES			142
326#define GCC_WCSS_DBG_IFC_NTS_BDG_CLK_ARES		143
327#define GCC_WCSS_DBG_IFC_NTS_CLK_ARES			144
328#define GCC_WCSS_ECAHB_CLK_ARES				145
329#define GCC_WCSS_MST_ASYNC_BDG_CLK_ARES			146
330#define GCC_WCSS_Q6_BCR					147
331#define GCC_WCSS_SLV_ASYNC_BDG_CLK_ARES			148
332#define GCC_XO_CLK_ARES					149
333#define GCC_XO_DIV4_CLK_ARES				150
334#define GCC_Q6SS_DBG_ARES				151
335#define GCC_WCSS_DBG_BDG_ARES				152
336#define GCC_WCSS_DBG_ARES				153
337#define GCC_WCSS_AXI_S_ARES				154
338#define GCC_WCSS_AXI_M_ARES				155
339#define GCC_WCSSAON_ARES				156
340#define GCC_PCIE3X2_PIPE_ARES				157
341#define GCC_PCIE3X2_CORE_STICKY_ARES			158
342#define GCC_PCIE3X2_AXI_S_STICKY_ARES			159
343#define GCC_PCIE3X2_AXI_M_STICKY_ARES			160
344#define GCC_PCIE3X1_0_PIPE_ARES				161
345#define GCC_PCIE3X1_0_CORE_STICKY_ARES			162
346#define GCC_PCIE3X1_0_AXI_S_STICKY_ARES			163
347#define GCC_PCIE3X1_0_AXI_M_STICKY_ARES			164
348#define GCC_PCIE3X1_1_PIPE_ARES				165
349#define GCC_PCIE3X1_1_CORE_STICKY_ARES			166
350#define GCC_PCIE3X1_1_AXI_S_STICKY_ARES			167
351#define GCC_PCIE3X1_1_AXI_M_STICKY_ARES			168
352#define GCC_IM_SLEEP_CLK_ARES				169
353#define GCC_NSSNOC_PCNOC_1_CLK_ARES			170
354#define GCC_UNIPHY0_XPCS_ARES				171
355#define GCC_UNIPHY1_XPCS_ARES				172
356#endif
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