1/*
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22 */
23#ifndef _lsdma_7_0_0_OFFSET_HEADER
24#define _lsdma_7_0_0_OFFSET_HEADER
25
26
27
28// addressBlock: lsdma0_lsdma0dec
29// base address: 0x45000
30#define regLSDMA_UCODE_ADDR                                                                             0x0000
31#define regLSDMA_UCODE_ADDR_BASE_IDX                                                                    0
32#define regLSDMA_UCODE_DATA                                                                             0x0001
33#define regLSDMA_UCODE_DATA_BASE_IDX                                                                    0
34#define regLSDMA_ERROR_INJECT_CNTL                                                                      0x0004
35#define regLSDMA_ERROR_INJECT_CNTL_BASE_IDX                                                             0
36#define regLSDMA_ERROR_INJECT_SELECT                                                                    0x0005
37#define regLSDMA_ERROR_INJECT_SELECT_BASE_IDX                                                           0
38#define regLSDMA_CONTEXT_GROUP_BOUNDARY                                                                 0x001f
39#define regLSDMA_CONTEXT_GROUP_BOUNDARY_BASE_IDX                                                        0
40#define regLSDMA_RB_RPTR_FETCH_HI                                                                       0x0020
41#define regLSDMA_RB_RPTR_FETCH_HI_BASE_IDX                                                              0
42#define regLSDMA_SEM_WAIT_FAIL_TIMER_CNTL                                                               0x0021
43#define regLSDMA_SEM_WAIT_FAIL_TIMER_CNTL_BASE_IDX                                                      0
44#define regLSDMA_RB_RPTR_FETCH                                                                          0x0022
45#define regLSDMA_RB_RPTR_FETCH_BASE_IDX                                                                 0
46#define regLSDMA_IB_OFFSET_FETCH                                                                        0x0023
47#define regLSDMA_IB_OFFSET_FETCH_BASE_IDX                                                               0
48#define regLSDMA_PROGRAM                                                                                0x0024
49#define regLSDMA_PROGRAM_BASE_IDX                                                                       0
50#define regLSDMA_STATUS_REG                                                                             0x0025
51#define regLSDMA_STATUS_REG_BASE_IDX                                                                    0
52#define regLSDMA_STATUS1_REG                                                                            0x0026
53#define regLSDMA_STATUS1_REG_BASE_IDX                                                                   0
54#define regLSDMA_RD_BURST_CNTL                                                                          0x0027
55#define regLSDMA_RD_BURST_CNTL_BASE_IDX                                                                 0
56#define regLSDMA_HBM_PAGE_CONFIG                                                                        0x0028
57#define regLSDMA_HBM_PAGE_CONFIG_BASE_IDX                                                               0
58#define regLSDMA_UCODE_CHECKSUM                                                                         0x0029
59#define regLSDMA_UCODE_CHECKSUM_BASE_IDX                                                                0
60#define regLSDMA_FREEZE                                                                                 0x002b
61#define regLSDMA_FREEZE_BASE_IDX                                                                        0
62#define regLSDMA_DCC_CNTL                                                                               0x002d
63#define regLSDMA_DCC_CNTL_BASE_IDX                                                                      0
64#define regLSDMA_POWER_GATING                                                                           0x002e
65#define regLSDMA_POWER_GATING_BASE_IDX                                                                  0
66#define regLSDMA_PGFSM_CONFIG                                                                           0x002f
67#define regLSDMA_PGFSM_CONFIG_BASE_IDX                                                                  0
68#define regLSDMA_PGFSM_WRITE                                                                            0x0030
69#define regLSDMA_PGFSM_WRITE_BASE_IDX                                                                   0
70#define regLSDMA_PGFSM_READ                                                                             0x0031
71#define regLSDMA_PGFSM_READ_BASE_IDX                                                                    0
72#define regLSDMA_BA_THRESHOLD                                                                           0x0033
73#define regLSDMA_BA_THRESHOLD_BASE_IDX                                                                  0
74#define regLSDMA_ID                                                                                     0x0034
75#define regLSDMA_ID_BASE_IDX                                                                            0
76#define regLSDMA_VERSION                                                                                0x0035
77#define regLSDMA_VERSION_BASE_IDX                                                                       0
78#define regLSDMA_EDC_COUNTER                                                                            0x0036
79#define regLSDMA_EDC_COUNTER_BASE_IDX                                                                   0
80#define regLSDMA_EDC_COUNTER2                                                                           0x0037
81#define regLSDMA_EDC_COUNTER2_BASE_IDX                                                                  0
82#define regLSDMA_STATUS2_REG                                                                            0x0038
83#define regLSDMA_STATUS2_REG_BASE_IDX                                                                   0
84#define regLSDMA_ATOMIC_CNTL                                                                            0x0039
85#define regLSDMA_ATOMIC_CNTL_BASE_IDX                                                                   0
86#define regLSDMA_ATOMIC_PREOP_LO                                                                        0x003a
87#define regLSDMA_ATOMIC_PREOP_LO_BASE_IDX                                                               0
88#define regLSDMA_ATOMIC_PREOP_HI                                                                        0x003b
89#define regLSDMA_ATOMIC_PREOP_HI_BASE_IDX                                                               0
90#define regLSDMA_UTCL1_CNTL                                                                             0x003c
91#define regLSDMA_UTCL1_CNTL_BASE_IDX                                                                    0
92#define regLSDMA_UTCL1_WATERMK                                                                          0x003d
93#define regLSDMA_UTCL1_WATERMK_BASE_IDX                                                                 0
94#define regLSDMA_UTCL1_RD_STATUS                                                                        0x003e
95#define regLSDMA_UTCL1_RD_STATUS_BASE_IDX                                                               0
96#define regLSDMA_UTCL1_WR_STATUS                                                                        0x003f
97#define regLSDMA_UTCL1_WR_STATUS_BASE_IDX                                                               0
98#define regLSDMA_UTCL1_INV0                                                                             0x0040
99#define regLSDMA_UTCL1_INV0_BASE_IDX                                                                    0
100#define regLSDMA_UTCL1_INV1                                                                             0x0041
101#define regLSDMA_UTCL1_INV1_BASE_IDX                                                                    0
102#define regLSDMA_UTCL1_INV2                                                                             0x0042
103#define regLSDMA_UTCL1_INV2_BASE_IDX                                                                    0
104#define regLSDMA_UTCL1_RD_XNACK0                                                                        0x0043
105#define regLSDMA_UTCL1_RD_XNACK0_BASE_IDX                                                               0
106#define regLSDMA_UTCL1_RD_XNACK1                                                                        0x0044
107#define regLSDMA_UTCL1_RD_XNACK1_BASE_IDX                                                               0
108#define regLSDMA_UTCL1_WR_XNACK0                                                                        0x0045
109#define regLSDMA_UTCL1_WR_XNACK0_BASE_IDX                                                               0
110#define regLSDMA_UTCL1_WR_XNACK1                                                                        0x0046
111#define regLSDMA_UTCL1_WR_XNACK1_BASE_IDX                                                               0
112#define regLSDMA_UTCL1_TIMEOUT                                                                          0x0047
113#define regLSDMA_UTCL1_TIMEOUT_BASE_IDX                                                                 0
114#define regLSDMA_UTCL1_PAGE                                                                             0x0048
115#define regLSDMA_UTCL1_PAGE_BASE_IDX                                                                    0
116#define regLSDMA_RELAX_ORDERING_LUT                                                                     0x004a
117#define regLSDMA_RELAX_ORDERING_LUT_BASE_IDX                                                            0
118#define regLSDMA_CHICKEN_BITS_2                                                                         0x004b
119#define regLSDMA_CHICKEN_BITS_2_BASE_IDX                                                                0
120#define regLSDMA_STATUS3_REG                                                                            0x004c
121#define regLSDMA_STATUS3_REG_BASE_IDX                                                                   0
122#define regLSDMA_PHYSICAL_ADDR_LO                                                                       0x004d
123#define regLSDMA_PHYSICAL_ADDR_LO_BASE_IDX                                                              0
124#define regLSDMA_PHYSICAL_ADDR_HI                                                                       0x004e
125#define regLSDMA_PHYSICAL_ADDR_HI_BASE_IDX                                                              0
126#define regLSDMA_ECC_CNTL                                                                               0x004f
127#define regLSDMA_ECC_CNTL_BASE_IDX                                                                      0
128#define regLSDMA_ERROR_LOG                                                                              0x0050
129#define regLSDMA_ERROR_LOG_BASE_IDX                                                                     0
130#define regLSDMA_PUB_DUMMY0                                                                             0x0051
131#define regLSDMA_PUB_DUMMY0_BASE_IDX                                                                    0
132#define regLSDMA_PUB_DUMMY1                                                                             0x0052
133#define regLSDMA_PUB_DUMMY1_BASE_IDX                                                                    0
134#define regLSDMA_PUB_DUMMY2                                                                             0x0053
135#define regLSDMA_PUB_DUMMY2_BASE_IDX                                                                    0
136#define regLSDMA_PUB_DUMMY3                                                                             0x0054
137#define regLSDMA_PUB_DUMMY3_BASE_IDX                                                                    0
138#define regLSDMA_F32_COUNTER                                                                            0x0055
139#define regLSDMA_F32_COUNTER_BASE_IDX                                                                   0
140#define regLSDMA_PERFCNT_PERFCOUNTER0_CFG                                                               0x0057
141#define regLSDMA_PERFCNT_PERFCOUNTER0_CFG_BASE_IDX                                                      0
142#define regLSDMA_PERFCNT_PERFCOUNTER1_CFG                                                               0x0058
143#define regLSDMA_PERFCNT_PERFCOUNTER1_CFG_BASE_IDX                                                      0
144#define regLSDMA_PERFCNT_PERFCOUNTER_RSLT_CNTL                                                          0x0059
145#define regLSDMA_PERFCNT_PERFCOUNTER_RSLT_CNTL_BASE_IDX                                                 0
146#define regLSDMA_PERFCNT_MISC_CNTL                                                                      0x005a
147#define regLSDMA_PERFCNT_MISC_CNTL_BASE_IDX                                                             0
148#define regLSDMA_PERFCNT_PERFCOUNTER_LO                                                                 0x005b
149#define regLSDMA_PERFCNT_PERFCOUNTER_LO_BASE_IDX                                                        0
150#define regLSDMA_PERFCNT_PERFCOUNTER_HI                                                                 0x005c
151#define regLSDMA_PERFCNT_PERFCOUNTER_HI_BASE_IDX                                                        0
152#define regLSDMA_CRD_CNTL                                                                               0x005d
153#define regLSDMA_CRD_CNTL_BASE_IDX                                                                      0
154#define regLSDMA_GPU_IOV_VIOLATION_LOG_BASE_IDX                                                         0
155#define regLSDMA_ULV_CNTL                                                                               0x005f
156#define regLSDMA_ULV_CNTL_BASE_IDX                                                                      0
157#define regLSDMA_EA_DBIT_ADDR_DATA                                                                      0x0060
158#define regLSDMA_EA_DBIT_ADDR_DATA_BASE_IDX                                                             0
159#define regLSDMA_EA_DBIT_ADDR_INDEX                                                                     0x0061
160#define regLSDMA_EA_DBIT_ADDR_INDEX_BASE_IDX                                                            0
161#define regLSDMA_STATUS4_REG                                                                            0x0063
162#define regLSDMA_STATUS4_REG_BASE_IDX                                                                   0
163#define regLSDMA_CE_CTRL                                                                                0x0066
164#define regLSDMA_CE_CTRL_BASE_IDX                                                                       0
165#define regLSDMA_EXCEPTION_STATUS                                                                       0x0067
166#define regLSDMA_EXCEPTION_STATUS_BASE_IDX                                                              0
167#define regLSDMA_INT_CNTL                                                                               0x0069
168#define regLSDMA_INT_CNTL_BASE_IDX                                                                      0
169#define regLSDMA_MEM_POWER_CTRL                                                                         0x006a
170#define regLSDMA_MEM_POWER_CTRL_BASE_IDX                                                                0
171#define regLSDMA_CLK_CTRL                                                                               0x006b
172#define regLSDMA_CLK_CTRL_BASE_IDX                                                                      0
173#define regLSDMA_CNTL                                                                                   0x006c
174#define regLSDMA_CNTL_BASE_IDX                                                                          0
175#define regLSDMA_CHICKEN_BITS                                                                           0x006d
176#define regLSDMA_CHICKEN_BITS_BASE_IDX                                                                  0
177#define regLSDMA_PIO_SRC_ADDR_LO                                                                        0x0070
178#define regLSDMA_PIO_SRC_ADDR_LO_BASE_IDX                                                               0
179#define regLSDMA_PIO_SRC_ADDR_HI                                                                        0x0071
180#define regLSDMA_PIO_SRC_ADDR_HI_BASE_IDX                                                               0
181#define regLSDMA_PIO_DST_ADDR_LO                                                                        0x0072
182#define regLSDMA_PIO_DST_ADDR_LO_BASE_IDX                                                               0
183#define regLSDMA_PIO_DST_ADDR_HI                                                                        0x0073
184#define regLSDMA_PIO_DST_ADDR_HI_BASE_IDX                                                               0
185#define regLSDMA_PIO_COMMAND                                                                            0x0074
186#define regLSDMA_PIO_COMMAND_BASE_IDX                                                                   0
187#define regLSDMA_PIO_CONSTFILL_DATA                                                                     0x0075
188#define regLSDMA_PIO_CONSTFILL_DATA_BASE_IDX                                                            0
189#define regLSDMA_PIO_CONTROL                                                                            0x0076
190#define regLSDMA_PIO_CONTROL_BASE_IDX                                                                   0
191#define regLSDMA_PIO_STATUS                                                                             0x007a
192#define regLSDMA_PIO_STATUS_BASE_IDX                                                                    0
193#define regLSDMA_PF_PIO_STATUS                                                                          0x007b
194#define regLSDMA_PF_PIO_STATUS_BASE_IDX                                                                 0
195#define regLSDMA_QUEUE0_RB_CNTL                                                                         0x0080
196#define regLSDMA_QUEUE0_RB_CNTL_BASE_IDX                                                                0
197#define regLSDMA_QUEUE0_RB_BASE                                                                         0x0081
198#define regLSDMA_QUEUE0_RB_BASE_BASE_IDX                                                                0
199#define regLSDMA_QUEUE0_RB_BASE_HI                                                                      0x0082
200#define regLSDMA_QUEUE0_RB_BASE_HI_BASE_IDX                                                             0
201#define regLSDMA_QUEUE0_RB_RPTR                                                                         0x0083
202#define regLSDMA_QUEUE0_RB_RPTR_BASE_IDX                                                                0
203#define regLSDMA_QUEUE0_RB_RPTR_HI                                                                      0x0084
204#define regLSDMA_QUEUE0_RB_RPTR_HI_BASE_IDX                                                             0
205#define regLSDMA_QUEUE0_RB_WPTR                                                                         0x0085
206#define regLSDMA_QUEUE0_RB_WPTR_BASE_IDX                                                                0
207#define regLSDMA_QUEUE0_RB_WPTR_HI                                                                      0x0086
208#define regLSDMA_QUEUE0_RB_WPTR_HI_BASE_IDX                                                             0
209#define regLSDMA_QUEUE0_RB_WPTR_POLL_CNTL                                                               0x0087
210#define regLSDMA_QUEUE0_RB_WPTR_POLL_CNTL_BASE_IDX                                                      0
211#define regLSDMA_QUEUE0_RB_WPTR_POLL_ADDR_HI                                                            0x0088
212#define regLSDMA_QUEUE0_RB_WPTR_POLL_ADDR_HI_BASE_IDX                                                   0
213#define regLSDMA_QUEUE0_RB_WPTR_POLL_ADDR_LO                                                            0x0089
214#define regLSDMA_QUEUE0_RB_WPTR_POLL_ADDR_LO_BASE_IDX                                                   0
215#define regLSDMA_QUEUE0_RB_RPTR_ADDR_HI                                                                 0x008a
216#define regLSDMA_QUEUE0_RB_RPTR_ADDR_HI_BASE_IDX                                                        0
217#define regLSDMA_QUEUE0_RB_RPTR_ADDR_LO                                                                 0x008b
218#define regLSDMA_QUEUE0_RB_RPTR_ADDR_LO_BASE_IDX                                                        0
219#define regLSDMA_QUEUE0_IB_CNTL                                                                         0x008c
220#define regLSDMA_QUEUE0_IB_CNTL_BASE_IDX                                                                0
221#define regLSDMA_QUEUE0_IB_RPTR                                                                         0x008d
222#define regLSDMA_QUEUE0_IB_RPTR_BASE_IDX                                                                0
223#define regLSDMA_QUEUE0_IB_OFFSET                                                                       0x008e
224#define regLSDMA_QUEUE0_IB_OFFSET_BASE_IDX                                                              0
225#define regLSDMA_QUEUE0_IB_BASE_LO                                                                      0x008f
226#define regLSDMA_QUEUE0_IB_BASE_LO_BASE_IDX                                                             0
227#define regLSDMA_QUEUE0_IB_BASE_HI                                                                      0x0090
228#define regLSDMA_QUEUE0_IB_BASE_HI_BASE_IDX                                                             0
229#define regLSDMA_QUEUE0_IB_SIZE                                                                         0x0091
230#define regLSDMA_QUEUE0_IB_SIZE_BASE_IDX                                                                0
231#define regLSDMA_QUEUE0_SKIP_CNTL                                                                       0x0092
232#define regLSDMA_QUEUE0_SKIP_CNTL_BASE_IDX                                                              0
233#define regLSDMA_QUEUE0_CSA_ADDR_LO                                                                     0x0093
234#define regLSDMA_QUEUE0_CSA_ADDR_LO_BASE_IDX                                                            0
235#define regLSDMA_QUEUE0_CSA_ADDR_HI                                                                     0x0094
236#define regLSDMA_QUEUE0_CSA_ADDR_HI_BASE_IDX                                                            0
237#define regLSDMA_QUEUE0_RB_AQL_CNTL                                                                     0x0095
238#define regLSDMA_QUEUE0_RB_AQL_CNTL_BASE_IDX                                                            0
239#define regLSDMA_QUEUE0_MINOR_PTR_UPDATE                                                                0x0096
240#define regLSDMA_QUEUE0_MINOR_PTR_UPDATE_BASE_IDX                                                       0
241#define regLSDMA_QUEUE0_CNTL                                                                            0x0097
242#define regLSDMA_QUEUE0_CNTL_BASE_IDX                                                                   0
243#define regLSDMA_QUEUE0_RB_PREEMPT                                                                      0x0098
244#define regLSDMA_QUEUE0_RB_PREEMPT_BASE_IDX                                                             0
245#define regLSDMA_QUEUE0_IB_SUB_REMAIN                                                                   0x0099
246#define regLSDMA_QUEUE0_IB_SUB_REMAIN_BASE_IDX                                                          0
247#define regLSDMA_QUEUE0_PREEMPT                                                                         0x009a
248#define regLSDMA_QUEUE0_PREEMPT_BASE_IDX                                                                0
249#define regLSDMA_QUEUE0_CONTEXT_STATUS                                                                  0x009b
250#define regLSDMA_QUEUE0_CONTEXT_STATUS_BASE_IDX                                                         0
251#define regLSDMA_QUEUE0_STATUS                                                                          0x009c
252#define regLSDMA_QUEUE0_STATUS_BASE_IDX                                                                 0
253#define regLSDMA_QUEUE0_DOORBELL                                                                        0x009d
254#define regLSDMA_QUEUE0_DOORBELL_BASE_IDX                                                               0
255#define regLSDMA_QUEUE0_DOORBELL_OFFSET                                                                 0x009e
256#define regLSDMA_QUEUE0_DOORBELL_OFFSET_BASE_IDX                                                        0
257#define regLSDMA_QUEUE0_DOORBELL_LOG                                                                    0x009f
258#define regLSDMA_QUEUE0_DOORBELL_LOG_BASE_IDX                                                           0
259#define regLSDMA_QUEUE0_WATERMARK                                                                       0x00a0
260#define regLSDMA_QUEUE0_WATERMARK_BASE_IDX                                                              0
261#define regLSDMA_QUEUE0_DUMMY0                                                                          0x00a1
262#define regLSDMA_QUEUE0_DUMMY0_BASE_IDX                                                                 0
263#define regLSDMA_QUEUE0_DUMMY1                                                                          0x00a2
264#define regLSDMA_QUEUE0_DUMMY1_BASE_IDX                                                                 0
265#define regLSDMA_QUEUE0_DUMMY2                                                                          0x00a3
266#define regLSDMA_QUEUE0_DUMMY2_BASE_IDX                                                                 0
267#define regLSDMA_QUEUE0_MIDCMD_DATA0                                                                    0x00c0
268#define regLSDMA_QUEUE0_MIDCMD_DATA0_BASE_IDX                                                           0
269#define regLSDMA_QUEUE0_MIDCMD_DATA1                                                                    0x00c1
270#define regLSDMA_QUEUE0_MIDCMD_DATA1_BASE_IDX                                                           0
271#define regLSDMA_QUEUE0_MIDCMD_DATA2                                                                    0x00c2
272#define regLSDMA_QUEUE0_MIDCMD_DATA2_BASE_IDX                                                           0
273#define regLSDMA_QUEUE0_MIDCMD_DATA3                                                                    0x00c3
274#define regLSDMA_QUEUE0_MIDCMD_DATA3_BASE_IDX                                                           0
275#define regLSDMA_QUEUE0_MIDCMD_DATA4                                                                    0x00c4
276#define regLSDMA_QUEUE0_MIDCMD_DATA4_BASE_IDX                                                           0
277#define regLSDMA_QUEUE0_MIDCMD_DATA5                                                                    0x00c5
278#define regLSDMA_QUEUE0_MIDCMD_DATA5_BASE_IDX                                                           0
279#define regLSDMA_QUEUE0_MIDCMD_DATA6                                                                    0x00c6
280#define regLSDMA_QUEUE0_MIDCMD_DATA6_BASE_IDX                                                           0
281#define regLSDMA_QUEUE0_MIDCMD_DATA7                                                                    0x00c7
282#define regLSDMA_QUEUE0_MIDCMD_DATA7_BASE_IDX                                                           0
283#define regLSDMA_QUEUE0_MIDCMD_DATA8                                                                    0x00c8
284#define regLSDMA_QUEUE0_MIDCMD_DATA8_BASE_IDX                                                           0
285#define regLSDMA_QUEUE0_MIDCMD_DATA9                                                                    0x00c9
286#define regLSDMA_QUEUE0_MIDCMD_DATA9_BASE_IDX                                                           0
287#define regLSDMA_QUEUE0_MIDCMD_DATA10                                                                   0x00ca
288#define regLSDMA_QUEUE0_MIDCMD_DATA10_BASE_IDX                                                          0
289#define regLSDMA_QUEUE0_MIDCMD_CNTL                                                                     0x00cb
290#define regLSDMA_QUEUE0_MIDCMD_CNTL_BASE_IDX                                                            0
291#define regLSDMA_QUEUE1_RB_CNTL                                                                         0x00d8
292#define regLSDMA_QUEUE1_RB_CNTL_BASE_IDX                                                                0
293#define regLSDMA_QUEUE1_RB_BASE                                                                         0x00d9
294#define regLSDMA_QUEUE1_RB_BASE_BASE_IDX                                                                0
295#define regLSDMA_QUEUE1_RB_BASE_HI                                                                      0x00da
296#define regLSDMA_QUEUE1_RB_BASE_HI_BASE_IDX                                                             0
297#define regLSDMA_QUEUE1_RB_RPTR                                                                         0x00db
298#define regLSDMA_QUEUE1_RB_RPTR_BASE_IDX                                                                0
299#define regLSDMA_QUEUE1_RB_RPTR_HI                                                                      0x00dc
300#define regLSDMA_QUEUE1_RB_RPTR_HI_BASE_IDX                                                             0
301#define regLSDMA_QUEUE1_RB_WPTR                                                                         0x00dd
302#define regLSDMA_QUEUE1_RB_WPTR_BASE_IDX                                                                0
303#define regLSDMA_QUEUE1_RB_WPTR_HI                                                                      0x00de
304#define regLSDMA_QUEUE1_RB_WPTR_HI_BASE_IDX                                                             0
305#define regLSDMA_QUEUE1_RB_WPTR_POLL_CNTL                                                               0x00df
306#define regLSDMA_QUEUE1_RB_WPTR_POLL_CNTL_BASE_IDX                                                      0
307#define regLSDMA_QUEUE1_RB_WPTR_POLL_ADDR_HI                                                            0x00e0
308#define regLSDMA_QUEUE1_RB_WPTR_POLL_ADDR_HI_BASE_IDX                                                   0
309#define regLSDMA_QUEUE1_RB_WPTR_POLL_ADDR_LO                                                            0x00e1
310#define regLSDMA_QUEUE1_RB_WPTR_POLL_ADDR_LO_BASE_IDX                                                   0
311#define regLSDMA_QUEUE1_RB_RPTR_ADDR_HI                                                                 0x00e2
312#define regLSDMA_QUEUE1_RB_RPTR_ADDR_HI_BASE_IDX                                                        0
313#define regLSDMA_QUEUE1_RB_RPTR_ADDR_LO                                                                 0x00e3
314#define regLSDMA_QUEUE1_RB_RPTR_ADDR_LO_BASE_IDX                                                        0
315#define regLSDMA_QUEUE1_IB_CNTL                                                                         0x00e4
316#define regLSDMA_QUEUE1_IB_CNTL_BASE_IDX                                                                0
317#define regLSDMA_QUEUE1_IB_RPTR                                                                         0x00e5
318#define regLSDMA_QUEUE1_IB_RPTR_BASE_IDX                                                                0
319#define regLSDMA_QUEUE1_IB_OFFSET                                                                       0x00e6
320#define regLSDMA_QUEUE1_IB_OFFSET_BASE_IDX                                                              0
321#define regLSDMA_QUEUE1_IB_BASE_LO                                                                      0x00e7
322#define regLSDMA_QUEUE1_IB_BASE_LO_BASE_IDX                                                             0
323#define regLSDMA_QUEUE1_IB_BASE_HI                                                                      0x00e8
324#define regLSDMA_QUEUE1_IB_BASE_HI_BASE_IDX                                                             0
325#define regLSDMA_QUEUE1_IB_SIZE                                                                         0x00e9
326#define regLSDMA_QUEUE1_IB_SIZE_BASE_IDX                                                                0
327#define regLSDMA_QUEUE1_SKIP_CNTL                                                                       0x00ea
328#define regLSDMA_QUEUE1_SKIP_CNTL_BASE_IDX                                                              0
329#define regLSDMA_QUEUE1_CSA_ADDR_LO                                                                     0x00eb
330#define regLSDMA_QUEUE1_CSA_ADDR_LO_BASE_IDX                                                            0
331#define regLSDMA_QUEUE1_CSA_ADDR_HI                                                                     0x00ec
332#define regLSDMA_QUEUE1_CSA_ADDR_HI_BASE_IDX                                                            0
333#define regLSDMA_QUEUE1_RB_AQL_CNTL                                                                     0x00ed
334#define regLSDMA_QUEUE1_RB_AQL_CNTL_BASE_IDX                                                            0
335#define regLSDMA_QUEUE1_MINOR_PTR_UPDATE                                                                0x00ee
336#define regLSDMA_QUEUE1_MINOR_PTR_UPDATE_BASE_IDX                                                       0
337#define regLSDMA_QUEUE1_CNTL                                                                            0x00ef
338#define regLSDMA_QUEUE1_CNTL_BASE_IDX                                                                   0
339#define regLSDMA_QUEUE1_RB_PREEMPT                                                                      0x00f0
340#define regLSDMA_QUEUE1_RB_PREEMPT_BASE_IDX                                                             0
341#define regLSDMA_QUEUE1_IB_SUB_REMAIN                                                                   0x00f1
342#define regLSDMA_QUEUE1_IB_SUB_REMAIN_BASE_IDX                                                          0
343#define regLSDMA_QUEUE1_PREEMPT                                                                         0x00f2
344#define regLSDMA_QUEUE1_PREEMPT_BASE_IDX                                                                0
345#define regLSDMA_QUEUE1_CONTEXT_STATUS                                                                  0x00f3
346#define regLSDMA_QUEUE1_CONTEXT_STATUS_BASE_IDX                                                         0
347#define regLSDMA_QUEUE1_STATUS                                                                          0x00f4
348#define regLSDMA_QUEUE1_STATUS_BASE_IDX                                                                 0
349#define regLSDMA_QUEUE1_DOORBELL                                                                        0x00f5
350#define regLSDMA_QUEUE1_DOORBELL_BASE_IDX                                                               0
351#define regLSDMA_QUEUE1_DOORBELL_OFFSET                                                                 0x00f6
352#define regLSDMA_QUEUE1_DOORBELL_OFFSET_BASE_IDX                                                        0
353#define regLSDMA_QUEUE1_DOORBELL_LOG                                                                    0x00f7
354#define regLSDMA_QUEUE1_DOORBELL_LOG_BASE_IDX                                                           0
355#define regLSDMA_QUEUE1_WATERMARK                                                                       0x00f8
356#define regLSDMA_QUEUE1_WATERMARK_BASE_IDX                                                              0
357#define regLSDMA_QUEUE1_DUMMY0                                                                          0x00f9
358#define regLSDMA_QUEUE1_DUMMY0_BASE_IDX                                                                 0
359#define regLSDMA_QUEUE1_DUMMY1                                                                          0x00fa
360#define regLSDMA_QUEUE1_DUMMY1_BASE_IDX                                                                 0
361#define regLSDMA_QUEUE1_DUMMY2                                                                          0x00fb
362#define regLSDMA_QUEUE1_DUMMY2_BASE_IDX                                                                 0
363#define regLSDMA_QUEUE1_MIDCMD_DATA0                                                                    0x0118
364#define regLSDMA_QUEUE1_MIDCMD_DATA0_BASE_IDX                                                           0
365#define regLSDMA_QUEUE1_MIDCMD_DATA1                                                                    0x0119
366#define regLSDMA_QUEUE1_MIDCMD_DATA1_BASE_IDX                                                           0
367#define regLSDMA_QUEUE1_MIDCMD_DATA2                                                                    0x011a
368#define regLSDMA_QUEUE1_MIDCMD_DATA2_BASE_IDX                                                           0
369#define regLSDMA_QUEUE1_MIDCMD_DATA3                                                                    0x011b
370#define regLSDMA_QUEUE1_MIDCMD_DATA3_BASE_IDX                                                           0
371#define regLSDMA_QUEUE1_MIDCMD_DATA4                                                                    0x011c
372#define regLSDMA_QUEUE1_MIDCMD_DATA4_BASE_IDX                                                           0
373#define regLSDMA_QUEUE1_MIDCMD_DATA5                                                                    0x011d
374#define regLSDMA_QUEUE1_MIDCMD_DATA5_BASE_IDX                                                           0
375#define regLSDMA_QUEUE1_MIDCMD_DATA6                                                                    0x011e
376#define regLSDMA_QUEUE1_MIDCMD_DATA6_BASE_IDX                                                           0
377#define regLSDMA_QUEUE1_MIDCMD_DATA7                                                                    0x011f
378#define regLSDMA_QUEUE1_MIDCMD_DATA7_BASE_IDX                                                           0
379#define regLSDMA_QUEUE1_MIDCMD_DATA8                                                                    0x0120
380#define regLSDMA_QUEUE1_MIDCMD_DATA8_BASE_IDX                                                           0
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383#define regLSDMA_QUEUE1_MIDCMD_DATA10                                                                   0x0122
384#define regLSDMA_QUEUE1_MIDCMD_DATA10_BASE_IDX                                                          0
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386#define regLSDMA_QUEUE1_MIDCMD_CNTL_BASE_IDX                                                            0
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388#endif
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