Searched refs:DPIO_CH1 (Results 1 - 6 of 6) sorted by relevance

/openbsd-current/sys/dev/pci/drm/i915/
H A Dintel_gvt_mmio_table.c1174 MMIO_D(BXT_PORT_PLL_EBB_0(DPIO_PHY0, DPIO_CH1));
1175 MMIO_D(BXT_PORT_PLL_EBB_4(DPIO_PHY0, DPIO_CH1));
1176 MMIO_D(BXT_PORT_PCS_DW10_LN01(DPIO_PHY0, DPIO_CH1));
1177 MMIO_D(BXT_PORT_PCS_DW10_GRP(DPIO_PHY0, DPIO_CH1));
1178 MMIO_D(BXT_PORT_PCS_DW12_LN01(DPIO_PHY0, DPIO_CH1));
1179 MMIO_D(BXT_PORT_PCS_DW12_LN23(DPIO_PHY0, DPIO_CH1));
1180 MMIO_D(BXT_PORT_PCS_DW12_GRP(DPIO_PHY0, DPIO_CH1));
1181 MMIO_D(BXT_PORT_TX_DW2_LN0(DPIO_PHY0, DPIO_CH1));
1182 MMIO_D(BXT_PORT_TX_DW2_GRP(DPIO_PHY0, DPIO_CH1));
1183 MMIO_D(BXT_PORT_TX_DW3_LN0(DPIO_PHY0, DPIO_CH1));
[all...]
/openbsd-current/sys/dev/pci/drm/i915/display/
H A Dintel_dpio_phy.h20 DPIO_CH1, enumerator in enum:dpio_channel
H A Dintel_dpio_phy.c172 [DPIO_CH1] = { .port = PORT_C },
259 port == phy_info->channel[DPIO_CH1].port) {
261 *ch = DPIO_CH1;
651 return DPIO_CH1;
679 return DPIO_CH1;
843 !chv_phy_powergate_ch(dev_priv, DPIO_PHY0, DPIO_CH1, true);
858 if (ch == DPIO_CH1)
866 if (ch == DPIO_CH1)
991 chv_phy_powergate_ch(dev_priv, DPIO_PHY0, DPIO_CH1, false);
H A Dintel_display_power_well.c1328 PHY_STATUS_CMN_LDO(DPIO_PHY0, DPIO_CH1) |
1329 PHY_STATUS_SPLINE_LDO(DPIO_PHY0, DPIO_CH1, 0) |
1330 PHY_STATUS_SPLINE_LDO(DPIO_PHY0, DPIO_CH1, 1));
1344 if ((phy_control & PHY_CH_POWER_DOWN_OVRD_EN(DPIO_PHY0, DPIO_CH1)) == 0)
1345 phy_control |= PHY_CH_POWER_DOWN_OVRD(0xf, DPIO_PHY0, DPIO_CH1);
1350 PHY_CH_POWER_DOWN_OVRD(0xf, DPIO_PHY0, DPIO_CH1)))
1359 PHY_CH_POWER_DOWN_OVRD(0xf, DPIO_PHY0, DPIO_CH1)) &&
1361 phy_status |= PHY_STATUS_CMN_LDO(DPIO_PHY0, DPIO_CH1);
1371 PHY_CH_POWER_DOWN_OVRD(0x3, DPIO_PHY0, DPIO_CH1)))
1372 phy_status |= PHY_STATUS_SPLINE_LDO(DPIO_PHY0, DPIO_CH1,
[all...]
H A Dintel_display_power.c1770 PHY_CH_POWER_MODE(PHY_CH_DEEP_PSR, DPIO_PHY0, DPIO_CH1) |
1799 PHY_CH_POWER_DOWN_OVRD_EN(DPIO_PHY0, DPIO_CH1);
1802 PHY_CH_POWER_DOWN_OVRD(mask, DPIO_PHY0, DPIO_CH1);
/openbsd-current/sys/dev/pci/drm/i915/gvt/
H A Dhandlers.c556 ch = DPIO_CH1;
2769 MMIO_DH(BXT_PORT_PCS_DW12_GRP(DPIO_PHY0, DPIO_CH1), D_BXT,
2771 MMIO_DH(BXT_PORT_TX_DW3_LN0(DPIO_PHY0, DPIO_CH1), D_BXT,

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