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H A Dbif_3_0_sh_mask.h8011 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT 0x00000002 macro
H A Dbif_5_0_sh_mask.h2818 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT 0x2 macro
H A Dbif_5_1_sh_mask.h3184 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT 0x2 macro
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/netbsd-current/sys/external/bsd/drm2/dist/drm/amd/include/asic_reg/nbio/
H A Dnbio_7_4_sh_mask.h43699 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT macro
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H A Dnbio_2_3_sh_mask.h55109 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT macro
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H A Dnbio_6_1_sh_mask.h38980 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT macro
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H A Dnbio_7_0_sh_mask.h74353 #define PCIE_WPR_CNTL__WPR_RESET_LNK_DIS_EN__SHIFT macro
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