Lines Matching defs:PHY_PCIE_IP_REG_AHB_LANE_CSR_3_X105_PMA_LN_TXDRV_BLEED_ENA_O_K2_E5
32726 #define PHY_PCIE_IP_REG_AHB_LANE_CSR_3_X105_PMA_LN_TXDRV_BLEED_ENA_O_K2_E5 (0x1<<5) // TX bleed enable