Lines Matching refs:S5P_CLKREG
18 #define S5P_CLKREG(x) (S3C_VA_SYS + (x))
20 #define S5P_APLL_LOCK S5P_CLKREG(0x00)
21 #define S5P_MPLL_LOCK S5P_CLKREG(0x08)
22 #define S5P_EPLL_LOCK S5P_CLKREG(0x10)
23 #define S5P_VPLL_LOCK S5P_CLKREG(0x20)
25 #define S5P_APLL_CON S5P_CLKREG(0x100)
26 #define S5P_MPLL_CON S5P_CLKREG(0x108)
27 #define S5P_EPLL_CON S5P_CLKREG(0x110)
28 #define S5P_VPLL_CON S5P_CLKREG(0x120)
30 #define S5P_CLK_SRC0 S5P_CLKREG(0x200)
31 #define S5P_CLK_SRC1 S5P_CLKREG(0x204)
32 #define S5P_CLK_SRC2 S5P_CLKREG(0x208)
33 #define S5P_CLK_SRC3 S5P_CLKREG(0x20C)
34 #define S5P_CLK_SRC4 S5P_CLKREG(0x210)
35 #define S5P_CLK_SRC5 S5P_CLKREG(0x214)
36 #define S5P_CLK_SRC6 S5P_CLKREG(0x218)
38 #define S5P_CLK_SRC_MASK0 S5P_CLKREG(0x280)
39 #define S5P_CLK_SRC_MASK1 S5P_CLKREG(0x284)
41 #define S5P_CLK_DIV0 S5P_CLKREG(0x300)
42 #define S5P_CLK_DIV1 S5P_CLKREG(0x304)
43 #define S5P_CLK_DIV2 S5P_CLKREG(0x308)
44 #define S5P_CLK_DIV3 S5P_CLKREG(0x30C)
45 #define S5P_CLK_DIV4 S5P_CLKREG(0x310)
46 #define S5P_CLK_DIV5 S5P_CLKREG(0x314)
47 #define S5P_CLK_DIV6 S5P_CLKREG(0x318)
48 #define S5P_CLK_DIV7 S5P_CLKREG(0x31C)
50 #define S5P_CLKGATE_MAIN0 S5P_CLKREG(0x400)
51 #define S5P_CLKGATE_MAIN1 S5P_CLKREG(0x404)
52 #define S5P_CLKGATE_MAIN2 S5P_CLKREG(0x408)
54 #define S5P_CLKGATE_PERI0 S5P_CLKREG(0x420)
55 #define S5P_CLKGATE_PERI1 S5P_CLKREG(0x424)
57 #define S5P_CLKGATE_SCLK0 S5P_CLKREG(0x440)
58 #define S5P_CLKGATE_SCLK1 S5P_CLKREG(0x444)
59 #define S5P_CLKGATE_IP0 S5P_CLKREG(0x460)
60 #define S5P_CLKGATE_IP1 S5P_CLKREG(0x464)
61 #define S5P_CLKGATE_IP2 S5P_CLKREG(0x468)
62 #define S5P_CLKGATE_IP3 S5P_CLKREG(0x46C)
63 #define S5P_CLKGATE_IP4 S5P_CLKREG(0x470)
65 #define S5P_CLKGATE_BLOCK S5P_CLKREG(0x480)
66 #define S5P_CLKGATE_BUS0 S5P_CLKREG(0x484)
67 #define S5P_CLKGATE_BUS1 S5P_CLKREG(0x488)
68 #define S5P_CLK_OUT S5P_CLKREG(0x500)
93 #define S5P_SWRESET S5P_CLKREG(0x2000)
96 #define S5P_PWR_CFG S5P_CLKREG(0xC000)
97 #define S5P_EINT_WAKEUP_MASK S5P_CLKREG(0xC004)
98 #define S5P_WAKEUP_MASK S5P_CLKREG(0xC008)
99 #define S5P_PWR_MODE S5P_CLKREG(0xC00C)
100 #define S5P_NORMAL_CFG S5P_CLKREG(0xC010)
101 #define S5P_IDLE_CFG S5P_CLKREG(0xC020)
102 #define S5P_STOP_CFG S5P_CLKREG(0xC030)
103 #define S5P_STOP_MEM_CFG S5P_CLKREG(0xC034)
104 #define S5P_SLEEP_CFG S5P_CLKREG(0xC040)
106 #define S5P_OSC_FREQ S5P_CLKREG(0xC100)
107 #define S5P_OSC_STABLE S5P_CLKREG(0xC104)
108 #define S5P_PWR_STABLE S5P_CLKREG(0xC108)
109 #define S5P_MTC_STABLE S5P_CLKREG(0xC110)
110 #define S5P_CLAMP_STABLE S5P_CLKREG(0xC114)
112 #define S5P_WAKEUP_STAT S5P_CLKREG(0xC200)
113 #define S5P_BLK_PWR_STAT S5P_CLKREG(0xC204)
115 #define S5P_OTHERS S5P_CLKREG(0xE000)
116 #define S5P_OM_STAT S5P_CLKREG(0xE100)
117 #define S5P_USB_PHY_CONTROL S5P_CLKREG(0xE80C)
118 #define S5P_DAC_CONTROL S5P_CLKREG(0xE810)
120 #define S5P_INFORM0 S5P_CLKREG(0xF000)
121 #define S5P_INFORM1 S5P_CLKREG(0xF004)
122 #define S5P_INFORM2 S5P_CLKREG(0xF008)
123 #define S5P_INFORM3 S5P_CLKREG(0xF00C)
124 #define S5P_INFORM4 S5P_CLKREG(0xF010)
125 #define S5P_INFORM5 S5P_CLKREG(0xF014)
126 #define S5P_INFORM6 S5P_CLKREG(0xF018)
127 #define S5P_INFORM7 S5P_CLKREG(0xF01C)
129 #define S5P_RST_STAT S5P_CLKREG(0xA000)
130 #define S5P_OSC_CON S5P_CLKREG(0x8000)
131 #define S5P_MDNIE_SEL S5P_CLKREG(0x7008)
132 #define S5P_MIPI_PHY_CON0 S5P_CLKREG(0x7200)
133 #define S5P_MIPI_PHY_CON1 S5P_CLKREG(0x7204)
134 #define S5P_MIPI_CONTROL S5P_CLKREG(0xE814)